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    V4374128C24VXXG-75 参数 Datasheet PDF下载

    V4374128C24VXXG-75图片预览
    型号： V4374128C24VXXG-75
    PDF下载： 下载PDF文件 查看货源
    内容描述： 1GB 168 -PIN挂号PLL ECC SDRAM DIMM 3.3伏128M X 72 [1GB 168-PIN REGISTERED PLL ECC SDRAM DIMM 3.3 VOLT 128M x 72]
    分类和应用： 动态存储器
    文件页数/大小： 13 页 / 309 K
    品牌： MOSEL [ MOSEL VITELIC, CORP ]
     浏览型号V4374128C24VXXG-75的Datasheet PDF文件第1页浏览型号V4374128C24VXXG-75的Datasheet PDF文件第2页浏览型号V4374128C24VXXG-75的Datasheet PDF文件第3页浏览型号V4374128C24VXXG-75的Datasheet PDF文件第4页浏览型号V4374128C24VXXG-75的Datasheet PDF文件第6页浏览型号V4374128C24VXXG-75的Datasheet PDF文件第7页浏览型号V4374128C24VXXG-75的Datasheet PDF文件第8页浏览型号V4374128C24VXXG-75的Datasheet PDF文件第9页  
    V4374128C24V
    写入电子
    2
    在模块亲PROM设备
    使用串行存在检测duction协议（I
    2
    C
    同步2线总线）
    串行存在检测存储设备 -
    2
    PROM - 组装到模块。信息
    E
    化有关模块的配置，速度等是
    CILETIV LESOM
    SPD-表：
    0
    1
    2
    3
    4
    内存类型
    5
    6
    7
    8
    9
    10
    11
    12
    13
    14
    15
    16
    17
    18
    19
    20
    21
    22
    23
    CS潜伏期
    WE潜伏期
    24
    25
    26
    27
    串行存在检测信息
    字节Num-
    BER
    函数来描述
    SPD的字节数
    在串行PD总字节
    十六进制值
    SPD项值
    128
    256
    SDRAM
    13
    11
    -75PC
    80
    08
    04
    0D
    0B
    -75
    80
    08
    04
    0D
    0B
    -10PC
    80
    08
    04
    0D
    0B
    行地址的数目（不包括BS比特）
    列地址数（ X8
    SDRAM ）
    DIMM银行数量
    模块数据宽度
    模块的数据宽度（续）
    模块接口电平
    SDRAM的周期时间在CL = 3
    从时钟在CL = 3 SDRAM存取时间
    DIMM配置（错误的Det /科尔。 ）
    刷新率/类型
    SDRAM宽度，主
    错误检查SDRAM的数据宽度
    最小时钟延迟从背靠背
    随机列地址
    突发长度支持
    SDRAM银行数量
    支持CAS潜伏期
    2
    72
    0
    LVTTL
    7.5纳秒/ 10.0纳秒
    5.4纳秒/ 6.0纳秒
    ECC
    自刷新， 7.8μs
    x4
    N / A / X4
    t
    CCD
    = 1 CLK
    1, 2, 4, 8
    4
    CL = 2,3
    CS延迟= 0
    WL = 0
    注册/缓冲
    VCC TOL ±10 ％
    7.5纳秒/ 10.0纳秒
    02
    48
    00
    01
    75
    54
    02
    82
    04
    04
    01
    02
    48
    00
    01
    75
    54
    02
    82
    04
    04
    01
    02
    48
    00
    01
    A0
    60
    02
    82
    04
    04
    01
    0F
    04
    06
    01
    01
    1F
    0E
    75
    0F
    04
    06
    01
    01
    1F
    0E
    A0
    0F
    04
    06
    01
    01
    1F
    0E
    A0
    SDRAM DIMM模块属性
    SDRAM的设备属性：一般
    最小时钟周期时间CAS延时
    =2
    最大数据存取时间从时钟为
    CL = 2
    最小时钟周期时间在CL = 1
    最大数据存取时间从时钟在
    CL = 1
    最小行预充电时间
    5.4纳秒/ 6.0纳秒
    54
    60
    60
    不支持
    不支持
    00
    00
    00
    00
    00
    00
    15纳秒/ 20纳秒
    0F
    14
    14
    V4374128C24V修订版1.1 2002年1月
    5

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