MT89L86
数据速率
2.048 Mb / s的
吞吐延迟（ D）
超前信息
D = [32 +（ 32 - IN） + （OUT - 1）] ; （在＃时隙表示）
2.048 Mb / s的时隙： 3.9μs
IN：输入时隙（ 1至32）
输出：输出时隙（ 1至32）
4.096 Mb / s的
D = [64 + （ 64 - IN） + （ OUT - 1 ） ]; （在＃时隙表示）
4.096 Mb / s的时隙： 1.95
µs
IN：输入时隙（ 1至64）
输出：输出时隙（ 1至64）
8.192 Mb / s的
D = [128 +（ 128 - IN） + （OUT - 1）] ; （在＃时隙表示）
8.192 Mb / s的时隙： 0.975
µs
IN：输入时隙（从1到128）
输出：输出时隙（从1到128）
表4 - 常量吞吐量延迟值
CON连接gurations输入和输出通道
提供了超过其相应的最小
吞吐量延迟，将有一个延迟的吞吐量等于
到输出和输入之间的差
渠道;即，通过延迟将小于
一个帧周期。表3a示出了通过
延迟为每个数据速率操作。
不同的I / O数据传输速率
除了2 Mb / s到4 Mb / s的和2 Mb / s至8
Mb / s的速率转换操作中，通过
从MT89L86延迟可以根据变化
用于切换输出流。
表3b说明了最坏的情况下为
吞吐量延迟，当不同的I / O数据传输率
开关CON连接gurations使用。
不断的吞吐延迟模式（V / C位= 1 ）
在这种模式下的帧序列的完整性被保持
在相同和不同的I / O数据传输率
通过利用多个数据存储器的操作
缓冲区技术。输入通道以任何的
在帧N的缓冲器期间将被读出
帧N + 2 。在应用程序的2.048 Mb / s的
例如，最小吞吐量延迟实现
在不断的延迟模式将是32个时隙;为
例如，当输入时隙32（通道31）是
切换到输出时隙1（信道0）。同样，
的最大延迟时间达到时，网络连接第一个时间
时隙在帧（通道0）切换到最后
时隙在帧（信道31 ），因此在94
时隙的延迟。
总之，任何输入时隙从输入帧N
将始终被切换到目标时隙
在输出帧N + 2 。表4描述了在恒定
通过延迟值在不同的数据速率。
10
微处理器端口
通过提供非多路复用总线接口
MT89L86是相同的，在MT8986提供
数字开关设备。除了非
复用总线，该3.3V MT89L86设备提供
具有增强的微处理器接口
复用总线结构兼容两种
摩托罗拉和英特尔总线。复用总线
结构的选择通过CPU接口模式（IM）的
输入引脚。
如果IM输入管脚连接到地，所述
MT89L86的并行端口假定它的缺省摩托罗拉
非复用总线模式完全相同的
MT8986 。如果IM输入连接高电平时，
内部并行微处理器端口提供
兼容性MOTEL （摩托罗拉和英特尔
兼容总线）接口，可以直接连接
英特尔，国家和摩托罗拉的CPU 。
片上MOTEL电路自动identi音响ES
CPU总线连接到该设备的类型。这
电路使用的DS / RD的输入的电平在
在AS / ALE的上升沿来确定适当的
总线定时连接到MT89L86 。如果DS / RD是
低在AS / ALE的上升沿则摩托罗拉
总线时序被选择。如果DS / RD为高电平的上升
AS / ALE的优势，英特尔总线时序选择。
当该设备的并行端口在运行
摩托罗拉，国家或Intel多路公交车
接口方面，可用于控制信号的
设备有： AD0 - AD7 （数据和地址） ， ALE / AS
（地址锁存使能/地址选通） ， DS / RD
（数据选通/读取） ， R / W \\ WR （读/写\\写） ，
CS （片选）和DTA （数据确认） 。
在摩托罗拉非复用总线模式中，所述
接口控制信号是：数据总线（ AD0 - AD7 ）
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