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TC7109CPL图片预览
型号: TC7109CPL
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内容描述: 12位レA兼容模拟 - 数字转换器 [12-Bit レA-Compatible Analog-to-Digital Converters]
分类和应用: 转换器模数转换器光电二极管PC
文件页数/大小: 30 页 / 480 K
品牌: MICROCHIP [ MICROCHIP TECHNOLOGY ]
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TC7109/A
MODE输入控制信号交换模式。当
MODE输入保持高电平时, TC7109A进入
后的新数据的握手方式已被存储在所述
输出锁存器在每次转换结束per-
形成(见图3-7和图) 。进入
握手模式,可以由需求引发的
MODE输入。在转换期间的任何时间,
短脉冲的低电平至高电平转换
MODE输入会导致立即进入手 -
防抖模式。如果在新的数据出现这种脉冲
被存储,进入握手模式是
延迟直到该数据是稳定的。 MODE输入
忽略在握手模式,并且直到
转换器将完成的输出周期和清除
握手模式,数据更新将被禁止(见
当MODE输入为高电平时,或当转换器
进入握手模式下,芯片和字节使能
输入成为TTL兼容输出,提供
输出的周期控制信号(见图3-7 ,图
和图3-9 ) 。该SEND输入由CON组
换器,作为接收的能力的指示
设备(如UART )接受在手 - 数据
防抖模式。输出周期与顺序
发送高举如图3-7所示。在手 -
防抖模式(内部模式高)后,进入
数据锁存脉冲(在CE / LOAD , LBEN和HBEN
终端被激活为输出,因为模式保持
HIGH ) 。
在发送输入的高电平检测到的
同样的高到低的内部时钟边沿。上的下一个
低到高的内部时钟边沿,高字节
(位9-12 ,POL和OR ),输出使能
和CE / LOAD和HBEN输出假设
低电平。在CE / LOAD输出保持低电平一
只有完整的内部时钟周期;数据输出保持
活性为1-1 / 2个内部时钟周期;与高字节
能保持为低2个时钟周期。
在CE / LOAD输出低电平,或低到高
边缘,可被用作同步信号,以确保
有效的数据,并且该字节使能作为一个输出可以是
作为一个字节的识别标志。随着SEND剩余
高时,转换器完成使用输出周期
CE / LOAD和LBEN ,而低位字节输出
(位1至8)被激活。当两个字节
发送时,信号交换模式被终止。典型的
的UART接口时序示于图。
该SEND输入用于延迟的部分
序列,或握手,以确保正确的数据传输
FER 。此时序图显示了一个行业标准
HD6403或CDP1854 CMOS UART接口到
串行数据通道。该输入发送到TC7109A
由TBRE (发送缓冲寄存器驱动
空)输出的UART ,以及在CE / LOAD输入
在TC7109A驱动TBRL (发送缓冲区
注册负载)输入到UART 。八发射
缓冲寄存器输入接收并行数据输出。
与UART发送缓冲寄存器空,
发送输入会很高,当握手模式
输入,之后新的数据被存储。高字节
输出变得活跃和CE / LOAD和HBEN
输入变低SEND被检测后,当CE /
负荷变高,在一个时钟周期结束时,将
高字节数据被移入UART和Transmit
器缓冲寄存器。 UART的TBRE输出变为低电平,
该停止输出周期与HBEN输出
低,而高位字节输出处于激活状态。当
UART具有传送的数据传送到发送器寄存器
之三和清除发送缓冲寄存器,
TBRE返回高电平。高字节输出
在接下来的TC7109A内部时钟高到残疾人
低边缘,和一个半内部时钟后, HBEN
输出为高电平。在CE / LOAD和LBEN输出
变为低电平,同时作为低位字节输出
变得活跃。当CE / LOAD HIGH在返回
一个时钟周期结束时,将低阶数据是
移入UART发送缓冲寄存器,
TBRE再次变低。接下来的TC7109A内部
时钟高电平到低电平的边缘会感觉到当TBRE
返回到高电平时,禁止数据的输入。二分之一
内部时钟后,握手模式被清除,
和CE / LOAD , HBEN和LBEN终端返回
高和保持活跃,如果模式仍然很高。
握手输出顺序,可以执行上
通过触发转换器进入握手需求
模式上的MODE输入一个低到高的边缘。一
触发握手输出序列示于
转换器进入握手模式。全输出
序列由SEND输入控制,并且
序列的第(高位)字节是类似于
序列的第二个字节。
花费比一个转换周期较长。新数据将不会
当握手模式仍处于被锁定
进展的,因此,失去了。
3.3
振荡器
该振荡器可被过驱动,或可被操作
作为一个RC或晶体振荡器。振荡器
SELECT输入优化的内部结构
振荡器为RC或晶体手术。该振荡
荡器的SELECT输入设置有上拉电阻
器。当振荡器选择输入为高电平或
悬空时,振荡器配置为RC的操作。
内部时钟将是相同的频率和
相视的缓冲振荡器信号
OUTPUT。连接的电阻器和电容器中
F = 0.45 / RC 。一个100k电阻建议使用 -
频率FUL范围。该电容值应为
选择,使得2048个时钟周期都接近一个
在60Hz的周期,以获得最佳为60Hz整数倍的
线路抑制。
DS21456C第12页
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2006年Microchip的科技公司