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GAL22V10B-15LJ 参数 Datasheet PDF下载

GAL22V10B-15LJ图片预览
型号: GAL22V10B-15LJ
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内容描述: 高性能E2CMOS PLD通用阵列逻辑 [High Performance E2CMOS PLD Generic Array Logic]
分类和应用: 可编程逻辑器件输入元件时钟
文件页数/大小: 29 页 / 387 K
品牌: LATTICE [ LATTICE SEMICONDUCTOR ]
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Specifications GAL22V10  
GAL22V10 Logic Diagram / JEDEC Fuse Map  
DIP (PLCC) Package Pinouts  
1 (2)  
0
4
8
12  
16  
20  
24  
28  
32  
36  
40  
ASYNCHRONOUS RESET  
(TO ALL REGISTERS)  
0000  
0044  
.
8
OLMC  
.
.
23 (27)  
S0  
0396  
5808  
S1  
5809  
0440  
.
10  
.
OLMC  
22 (26)  
S0  
.
.
5810  
S1  
5811  
0880  
2 (3)  
3 (4)  
0924  
.
.
.
.
.
12  
OLMC  
21 (25)  
20 (24)  
S0  
5812  
S1  
1452  
5813  
1496  
.
.
14  
16  
.
OLMC  
.
S0  
5814  
S1  
.
.
2112  
5815  
4 (5)  
5 (6)  
2156  
.
.
.
19 (23)  
18 (21)  
17 (20)  
.
OLMC  
.
S0  
5816  
S1  
.
.
2860  
5817  
2904  
.
.
.
16  
.
OLMC  
.
S0  
5818  
S1  
.
.
3608  
5819  
6 (7)  
7 (9)  
3652  
.
.
14  
12  
.
OLMC  
.
S0  
5820  
S1  
.
.
4268  
5821  
4312  
.
.
OLMC  
.
16 (19)  
15 (18)  
.
.
S0  
5822  
S1  
4840  
5823  
8 (10)  
9 (11)  
4884  
.
.
10  
8
OLMC  
.
.
S0  
5824  
S1  
5324  
5825  
5368  
.
.
.
OLMC  
14 (17)  
13 (16)  
S0  
5826  
S1  
5720  
5827  
10 (12)  
11 (13)  
5764  
SYNCHRONOUS PRESET  
(TO ALL REGISTERS)  
5828, 5829 ... Electronic Signature ... 5890, 5891  
Byte 7 Byte 6 Byte 5 Byte 4 Byte 3 Byte 2 Byte 1 Byte 0  
M
S
B
L
S
B
5