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CY7C1350G-133AXC 参数 Datasheet PDF下载

CY7C1350G-133AXC图片预览
型号: CY7C1350G-133AXC
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内容描述: 4兆位( 128K ×36 )流水线SRAM与NOBL ?架构 [4-Mbit (128K x 36) Pipelined SRAM with NoBL? Architecture]
分类和应用: 存储内存集成电路静态存储器时钟
文件页数/大小: 15 页 / 336 K
品牌: CYPRESS [ CYPRESS SEMICONDUCTOR ]
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CY7C1350G
开关波形
读/写时序
[19, 20, 21]
1
CLK
t
CENS
t
CENH
2
吨CYC
3
4
5
6
7
8
9
10
t
CH
t
CL
CEN
t
CES
t
CEH
CE
ADV / LD
WE
BW
[A :D ]
地址
t
AS
A1
t
AH
A2
t
DS
t
DH
A3
A4
t
CO
t
CLZ
t
DOH
A5
t
OEV
A6
t
CHZ
A7
数据
IN-OUT ( DQ )
D(A1)
D(A2)
D(A2+1)
Q(A3)
Q(A4)
t
OEHZ
Q(A4+1)
D(A5)
Q(A6)
t
DOH
OE
D(A1)
D(A2)
BURST
D(A2+1)
Q(A3)
Q(A4)
BURST
Q(A4+1)
D(A5)
t
OELZ
Q(A6)
D(A7)
DESELECT
不在乎
未定义
注意事项:
19.对于这种波形ZZ是绑低。
20.当CE为低电平,CE
1
为低电平,CE
2
为HIGH和CE
3
为LOW 。当CE为高电平,CE
1
为高或CE
2
低或CE
3
为高。
21.秩序的突发序列是由MODE ( 0 =线性, 1 =交错)的状态决定。脉冲串操作是可选的。
文件编号: 38-05524牧师* ˚F
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