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ADSP-BF532SBBZ400 参数 Datasheet PDF下载

ADSP-BF532SBBZ400图片预览
型号: ADSP-BF532SBBZ400
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内容描述: Blackfin嵌入式处理器 [Blackfin Embedded Processor]
分类和应用: 微控制器和处理器外围集成电路数字信号处理器时钟
文件页数/大小: 60 页 / 3025 K
品牌: AD [ ANALOG DEVICES ]
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ADSP-BF531/ADSP-BF532
串口
通过
通过
描述串行端口
操作。
表21.串行端口,外部时钟
V
DDEXT
= 1.8 V V
DDEXT
= 2.5 V/3.3 V
MIN MAX MIN
最大
单位
3.0
3.0
3.0
3.0
4.5
15.0
10.0
0.0
10.0
0.0
0.0
0.0
10.0
3.0
3.0
3.0
3.0
4.5
15.0
10.0
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
参数
时序要求
t
SFSE
TFS / RFS设置TSCLK / RSCLK前
1
t
高场强元素
TFS / RFS保持后TSCLK / RSCLK
1
t
SDRE
接收数据设置RSCLK前
1
t
HDRE
接收数据保持RSCLK后
1
t
SCLKEW
TSCLK / RSCLK宽度
TSCLK / RSCLK期
t
SCLKE
开关特性
t
DFSE
TFS / RFS延迟后TSCLK / RSCLK (内部产生的TFS / RFS )
2
t
HOFSE
TFS / RFS保持后TSCLK / RSCLK (内部产生的TFS / RFS )
1
t
DDTE
数据传输延迟TSCLK后
1
t
HDTE
传输数据保持TSCLK后
1
1
2
参考样的优势。
引用驱动力。
表22.串行端口,内部时钟
V
DDEXT
= 1.8 V V
DDEXT
= 2.5 V/3.3 V
MIN MAX MIN
最大
单位
11.0
−2.0
9.0
0.0
4.5
15.0
3.0
−1.0
3.0
−2.0
4.5
−2.0
4.5
−1.0
3.0
9.0
−2.0
9.0
0.0
4.5
15.0
3.0
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
参数
时序要求
t
SFSI
TFS / RFS设置TSCLK / RSCLK前
1
t
HFSI
TFS / RFS保持后TSCLK / RSCLK
1
t
SDRI
接收数据设置RSCLK前
1
t
HDRI
接收数据保持RSCLK后
1
t
SCLKEW
TSCLK / RSCLK宽度
t
SCLKE
TSCLK / RSCLK期
开关特性
t
DFSI
TFS / RFS延迟后TSCLK / RSCLK (内部产生的TFS / RFS )
2
t
HOFSI
TFS / RFS保持后TSCLK / RSCLK (内部产生的TFS / RFS )
1
t
DDTI
数据传输延迟TSCLK后
1
传输数据保持TSCLK后
1
t
HDTI
t
SCLKIW
TSCLK / RSCLK宽度
1
2
参考样的优势。
引用驱动力。
修订版D |
第32页60 |
2006年8月