MT88E45
引脚说明
PIN ＃ NAME
10
数据
描述
数据表
3线FSK数据接口（ CMOS输出） 。
马克频率对应于逻辑1.空间
频率对应于逻辑0 。
在模式0时（ CB0引脚为逻辑低） FSK的串行比特流输出到DATA引脚
直接。
在模式1 （当CB0引脚为逻辑高电平），起始位被剥离，数据字节和结尾
停止位被存储在一个9比特缓冲器。在每一个单词的结尾由DR / STD引脚激活时，
微控制器应通过将8读脉冲的DCLK转移出的字节到数据引脚
引脚。第9个DCLK脉冲将移出停止位帧错误检查。
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DR / STD
3线接口FSK数据就绪/ CAS延迟检测指导（ CMOS输出） 。
活跃
低。
当FSK解调通过CB1和CB2引脚使能该引脚是数据就绪输出。
它表示一个字的结束。在两个FSK接口模式0和1 ，通常喜和变低
为半个位时间在一个字的结尾。但在模式1 ，如果DCLK DR在启动低，网络第一个崛起
在DCLK输入的边缘返回DR高。此功能允许通过一个低请求中断
在读第一个数据位将DR清零。
当通过CB1和CB2引脚启用CAS检测该引脚为指导延迟输出。
它为低时，表示一个时间限定CAS号已被检测到。
美东时间
CAS检测早期指导（ CMOS输出） 。
高电平有效。该引脚为原料CAS检测
输出。它变为高以指示一个信号的会议的存在下在CAS接受频率和
信号电平。这是用在与ST / GT引脚的外部组件相结合，并限定时间
的检测，以确定该信号是否是一个真实的CAS号。
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ST / GT
CAS检测转向/保护时间（ CMOS输出/模拟输入） 。
它结合使用
与EST销和外部元件以时间限定的检测，以确定是否
信号是一个真正的CAS 。
比伏的电压越大
TGT
在该引脚使MT88E45B时，表示一个CAS号已经
通过认定的DR / STD引脚为低电平检测。比伏的电压更低
TGT
解放了MT88E45B到
接受新的CAS ，并返回DR / STD高。
CD
载波检测（ CMOS输出） 。
低电平有效。
逻辑低电平表示一个FSK信号出现。一时间滞后是为了允许
瞬时信号的连续性。解调的FSK数据被MT88E45B忽略，直到
载波检测已被激活。
正电源。
控制位1 （ CMOS输入） 。
与CB2此引脚选择MT88E45B的功能
与FSK解调，提示/环CAS检测和混合CAS检测。
当CB0是高和CB1 ， CB2都低的MT88E45B放入掉电状态
消耗最小的电源电流。见表1和表2 。
控制位2 （ CMOS输入） 。
与CB1此引脚选择MT88E45B的功能
与FSK解调，提示/环CAS检测和混合CAS检测。
当CB0是高和CB1 ， CB2都低的MT88E45B放入掉电状态
消耗最小的电源电流。见表1和表2 。
混合增益选择（输出） 。
这是混合的输出接收连接的运算放大器。了选购
安培应使用的MT88E45B连接到电话杂交或语音集成电路接收对。
该混合接收信号可以经由选择的反馈来放大或衰减，在GS2
GS2和IN2-之间的电阻。当CPE是摘机CAS检测GS2信号的
应通过CB1和CB2的引脚被激活。见表1和表2 。
混合运算放大器反相（输入） 。
混合运算放大器同相（输入） 。
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VDD
CB1
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CB2
18
GS2
19
20
IN2-
IN2+
4
卓联半导体公司
ZARLINK [ ZARLINK SEMICONDUCTOR INC ]
