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TP3057N/NOPB 参数 Datasheet PDF下载

TP3057N/NOPB图片预览
型号: TP3057N/NOPB
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内容描述: [TP3052, TP3053, TP3054, TP3057, Enhanced Serial Interface CODEC/Filter COMBO Family 16-PDIP]
分类和应用: 解码器编解码器
文件页数/大小: 18 页 / 299 K
品牌: TI [ TEXAS INSTRUMENTS ]
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功能说明
上电
当电源首次加电复位电路initializ-
ES组合,并将其放在一个掉电状态所有
非必要的电路被停用和D
X
和VF
R
O
输出处于高阻抗状态上电了
设备的逻辑低电平或时钟必须被施加到
MCLK
R
PDN引脚
FS
X
和FS或
R
脉冲必须是压力
耳鼻喉科因此2断电控制模式可供选择的
首先是拉MCLK
R
PDN引脚为高电平的另一种方法是
同时按住FS
X
和FS
R
该设备的投入持续低
将掉电最后FS后约1毫秒
X
or
FS
R
将发生在第一FS脉冲电
X
或FS
R
脉冲三态PCM数据输出D
X
将保持在
高阻抗状态,直到第二FS
X
脉冲
同步操作
对于同步运行相同的主时钟,位
时钟应同时用于发射和接收二
rections在这种模式下时钟必须施加的MCLK
X
和MCLK
R
PDN端可用作掉电
控制在MCLK低水平
R
PDN上电设备
和高水平的对设备断电。在两种情况下
MCLK
X
将被选择作为主时钟的两个所述
发射和接收电路的时钟位也必须是AP-
合股BCLK
X
与BCLK
R
CLKSEL可以用来
选择合适的内部分频器为1 536的主时钟
兆赫1 544 MHz或2048 MHz的频率1 544 MHz运行
该设备可自动补偿的193个时钟
脉搏每帧
与BCLK的一个固定电平
R
CLKSEL引脚BCLK
X
选择为位时钟为发送和接收
指示表1表明操作的频率
它可以根据BCLK的状态来选择
R
CLKSEL在该同步模式的比特时钟BCLK
X
可以是从64千赫至2 048兆赫,但必须同步
理性与MCLK
X
每个FS
X
脉冲开始的编码周期和PCM
从过去的编码周期的数据被移位的出
ð启用
X
在BCLK的上升沿输出
X
经过8
位时钟周期的TRI-状态D
X
输出被返回到一
高阻抗状态,随着FS
R
脉冲PCM数据是
通过D锁存
R
输入在BCLK的下降沿
X
(或
BCLK
R
如果正在运行) FS
X
和FS
R
必须是同步的
MCLK
个R
表我选择的主时钟频率的
BCLK
R
CLKSEL
主频
0
1
主时钟
频率选择
TP3057
2 048 MHz的
1 536 MHz或
1 544 MHz的
2 048 MHz的
TP3054
1 536 MHz或
1 544 MHz的
2 048 MHz的
1 536 MHz或
1 544 MHz的
异步操作
对于异步操作,单独的发射和接收
时钟可以应用于MCLK
X
和MCLK
R
必须是
2 048兆赫的TP3057或1 536 MHz的1 544兆赫的
TP3054的,不一定同步获得最佳transmis-
锡永的表现却MCLK
R
应该是同步的
与MCLK
X
这是很容易申请只实现了静态
逻辑电平到MCLK
R
PDN引脚这将自动
连接MCLK
X
所有内部MCLK
R
功能(参见引脚
说明)对于1 544 MHz运行的设备automati-
美云进行补偿的第193个时钟脉冲的每一帧
FS
X
开始,每个编码周期,并且必须是同步的
与MCLK
X
与BCLK
X
FS
R
开始每个解码周期
且必须是同步的BCLK
R
BCLK
R
必须是一个
时钟在表1所示的逻辑电平不在有效
异步模式BCLK
X
与BCLK
R
可从操作
64 kHz至2 MHz的048
短帧同步操作
组合可以利用任何一个短帧同步脉冲或
长帧同步脉冲刚上电时器件
假设一个短帧模式在此模式下两个帧同步
脉冲FS
X
和FS
R
必须是一个位时钟周期长
在规定的时序关系
图2
与FS
X
BCLK的下降沿期间
X
下一个上升沿
BCLK
X
能够为D
X
三态输出缓冲器这将
输出符号位以下七个上升沿时钟
从余下的七位和下一个下降沿显示
禁止进入ð
X
输出带FS
R
的下降沿期间,高
BCLK
R
( BCLK
X
在同步模式)下一个下降沿
BCLK的
R
在标志位锁存器的以下七个下降
边锁在剩下的七位所有四款器件
可利用短帧同步脉冲在同步或
异步工作模式
长帧同步操作
使用长帧模式两种帧同步脉冲
FS
X
和FS
R
必须是三个或更多位时钟周期,
在规定的时序关系
科幻gure 3
基于该
发送帧同步FS
X
该组合会感觉是否
或长或短帧同步脉冲被用来对于64 kHz的
操作的帧同步脉冲必须保持低的微型
160纳秒为D妈妈
X
三态输出缓冲器启用
用FS的上升沿
X
或BCLK的上升缘
X
以后到者为准,并在第一位主频出来的
符号位以下七个BCLK
X
沿输出
剩余的7位为D
X
输出由关闭
BCLK下降
X
缘以下的第八个上升沿或由
FS
X
变低以先到者为准后来一个上升沿
接收帧同步脉冲FS
R
将导致的PCM数据在
D
R
在BCLK的下八下降沿被锁存
R
( BCLK
X
在同步模式下),所有四款器件可利用
长帧同步脉冲在同步或异步
模式
在应用中的最低位位被用于带信号
FS
R
2位时钟周期,解码器将解释
失去了LSB为' ''' ,以减少噪声和失真
3