SNLS167K - 2004年3月 - 修订2013年4月
+ 3.3V可编程LVDS发射器24位平板显示器链接， 87.5兆赫
检查样品：
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特点
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引脚对引脚兼容于DS90C383 ，
DS90C383A和DS90C385
不需要特殊的启动顺序
之间的时钟/数据及/ PD引脚。输入
信号（时钟和数据）能应用于
之前或之后的器件上电。
支持扩频时钟可达
100kHz的频率调制和偏差
±2.5 ％中心扩频或-5 ％，价差下跌
“输入时钟Detection"功能将全部拉出
LVDS双为逻辑低电平时，输入时钟
失踪时/ PD引脚为逻辑高电平
18〜 87.5 MHz的移位时钟支持
TX功耗< 147毫瓦（典型值） ，在
87.5MHZ灰度
TX掉电模式< 60
μW
（典型值）
支持VGA ， SVGA ， XGA ， SXGA （双像素） ，
SXGA + （双像素） ， UXGA （双像素） 。
窄总线减少了线缆的尺寸和成本
高达2.45 Gbps的吞吐量
截至306.25Megabyte /秒的带宽
345毫伏（典型值） LVDS摆幅低EMI器件
PLL无需外部元件
兼容于TIA / EIA- 644 LVDS标准
薄型56引脚TSSOP封装
描述
该DS90C385A是引脚对引脚兼容
替代DS90C383 ， DS90C383A和
DS90C385 。该DS90C385A具有附加功能
和改进使其成为理想的替代品
DS90C383 ， DS90C383A和DS90C385 。家庭
LVDS发送器。
该DS90C385A变送器转换的28位
LVCMOS / LVTTL数据转换4 LVDS（低压
差分信号）数据流。锁相
发送时钟是平行于数据传输的
流过第五个LVDS链路。的每个周期
传送时钟的输入数据的28位进行采样和
传输。在87.5的发送时钟的频率
兆赫的RGB数据24比特和LCD时序3位
和控制数据（ FPLINE ， FPFRAME ， DRDY ）是
每LVDS数据速率612.5Mbps的传输
通道。用87.5 MHz的时钟，数据吞吐量
是306.25Mbytes /秒。该发射器可
编程为上升沿频闪或下降沿
频闪通过专用引脚。上升沿或
下降沿频闪发射将与互操作
下降沿频闪FPDLink接收器没有任何
转换逻辑。
该芯片组是解决EMI和理想的途径
宽，高速相关的电缆尺寸问题
添加了扩频时钟TTL接口
支持。
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框图
图1. DS90C385A
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