DS_1903_032
73M1903 Data Sheet
SCLK
FS(mode1)
SDIN
SDOUT
TX15
RX15
TX14
RX14
TX13
RX13
TX12
RX12
TX11
RX11
TX10
RX10
TX9
RX9
TX8
RX8
TX7
RX7
TX6
RX6
TX5
RX5
TX4
RX4
TX3
RX3
TX2
RX2
TX1
RX1
CTL
RX0
Data Frame With Early Frame Sync
SCLK
FS(mode1)
SDIN
SDOUT
R/W
zero
A6
zero
A5
zero
A4
zero
A3
zero
A2
zero
A1
zero
A0
zero
DI7
DO7
DI6
DO6
DI5
DO5
DI4
DO4
DI3
DO3
DI2
DO2
DI1
DO1
DI0
DO0
Control Frame With Early Frame Sync
SCLK
FS(mode0)
SDIN
R/W
zero
SDOUT
Control Frame With Late Frame Sync
A6
zero
A5
zero
A4
zero
A3
zero
A2
zero
A1
zero
A0
zero
DI7
DO7
DI6
DO6
DI5
DO5
DI4
DO4
DI3
DO3
DI2
DO2
DI1
DO1
DI0
DO0
7.2KHz (8KHz)
SCLK
FS
SDIN
SDOUT
TX
RX
TX
RX
TX
RX
Data Frame
TX
RX
TX
RX
1
RX
R
0
A
0
A
0
A
0
DI
DO
DI
DO
DI
DO
TX
RX
TX
RX
TX
RX
Data Frame
TX
RX
TX
RX
0
RX
Control Frame
Relation Between the Data and Control Frames
Figure 3:
Serial Port Timing Diagram
Rev. 2.0
9
TERIDIAN [ TERIDIAN SEMICONDUCTOR CORPORATION ]
