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    STM32F103RBT7XXX 参数 Datasheet PDF下载

    STM32F103RBT7XXX图片预览
    型号： STM32F103RBT7XXX
    PDF下载： 下载PDF文件 查看货源
    内容描述： 中密度高性能线的基于ARM的32位MCU，具有64或128 KB的闪存， USB ， CAN ，7个定时器， 2的ADC ，9个通信接口 [Medium-density performance line ARM-based 32-bit MCU with 64 or 128 KB Flash, USB, CAN, 7 timers, 2 ADCs, 9 communication interfaces]
    分类和应用： 闪存微控制器和处理器外围集成电路通信时钟
    文件页数/大小： 92 页 / 1212 K
    品牌： STMICROELECTRONICS [ STMICROELECTRONICS ]
     浏览型号STM32F103RBT7XXX的Datasheet PDF文件第33页浏览型号STM32F103RBT7XXX的Datasheet PDF文件第34页浏览型号STM32F103RBT7XXX的Datasheet PDF文件第35页浏览型号STM32F103RBT7XXX的Datasheet PDF文件第36页浏览型号STM32F103RBT7XXX的Datasheet PDF文件第38页浏览型号STM32F103RBT7XXX的Datasheet PDF文件第39页浏览型号STM32F103RBT7XXX的Datasheet PDF文件第40页浏览型号STM32F103RBT7XXX的Datasheet PDF文件第41页  
    STM32F103x8 ， STM32F103xB
    表11 。
    符号
    电气特性
    内置复位和电源控制模块特性
    参数
    条件
    PLS [2：0 ] = 000 （上升沿）
    PLS [2：0 ] = 000 （下降沿）
    PLS [2：0 ] = 001 （上升沿）
    PLS [2：0 ] = 001 （下降沿）
    PLS [2：0 ] = 010 （上升沿）
    PLS [2：0 ] = 010 （下降沿）
    PLS [2：0 ] = 011 （上升沿）
    民
    2.1
    2
    2.19
    2.09
    2.28
    2.18
    2.38
    2.28
    2.47
    2.37
    2.57
    2.47
    2.66
    2.56
    2.76
    2.66
    典型值
    2.18
    2.08
    2.28
    2.18
    2.38
    2.28
    2.48
    2.38
    2.58
    2.48
    2.68
    2.58
    2.78
    2.68
    2.88
    2.78
    100
    下降沿
    上升沿
    1.8
    (1)
    1.84
    1.88
    1.92
    40
    1
    2.5
    4.5
    1.96
    2.0
    最大
    2.26
    2.16
    2.37
    2.27
    2.48
    2.38
    2.58
    2.48
    2.69
    2.59
    2.79
    2.69
    2.9
    2.8
    3
    2.9
    单位
    V
    V
    V
    V
    V
    V
    V
    V
    V
    V
    V
    V
    V
    V
    V
    V
    mV
    V
    V
    mV
    ms
    V
    PVD
    可编程电压
    检测电平选择
    PLS [2：0 ] = 011 （下降沿）
    PLS [2：0 ] = 100 （上升沿）
    PLS [2：0 ] = 100 （下降沿）
    PLS [2：0 ] = 101 （上升沿）
    PLS [2：0 ] = 101 （下降沿）
    PLS [2：0 ] = 110 （上升沿）
    PLS [2：0 ] = 110 （下降沿）
    PLS [2：0 ] = 111 （上升沿）
    PLS [2：0 ] = 111 （下降沿）
    V
    PVDhyst(2)
    V
    POR / PDR
    V
    PDRhyst(2)
    PVD迟滞
    开机/关机
    复位门限
    PDR迟滞
    T
    RSTTEMPO(2)
    复位因循
    2.通过设计保证，不在生产中测试。
    1.该产品的行为是有保证通过设计降低到最小V
    POR / PDR
    值。
    文档ID 13587牧师11
    37/92

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