622.08兆赫
光定时时钟
差分输出对称性
- 为平衡输出负载， OP4005B的差分输出对称性为±1％ 。
该差分输出对称性满足最苛刻的高速逻辑家庭的需求。
输出直流电压可配置
- 在OP4005B差分输出可直流配置，以支持广泛的高
高速逻辑电路系列和ASIC驱动要求由四个电阻的选择（请参阅配置OP4005B直流输出
电压以下），一个逻辑电路的电源电压。该OP4005B的每个差分输出是交流耦合，以提供这种灵活性。
OP4005B调整详情
该OP4005B的频率调谐，其特征在于在0的电压范围内，以3.3伏施加到所述的调谐电压
OP4005B应限制在此范围内。图4显示了在-40或+85°C典型的锁定调谐范围的操作。
随着温度的石英声表面波的频率控制装置的频率偏移具有一个倒抛物线的形状，与
最高频率出现的围绕25 ℃。在两个-40和85 ℃下，将有在频170 ppm的向下移动
SAW器件的昆西相比25 ℃。调整，以补偿这种温度位移是相同的调谐
170 ppm的在25 ° C以上。这是完全在OP4005B的调谐范围，如示于图4 。注意，电压
调整常数K
V
，被锁定的条件下，在140和300 PPM / V为界内的任何温度
OP4005B的规定的工作范围。
该OP4005B调谐端口呈现的输入阻抗大于100千欧，从直流到50kHz以上，并且至少为1千欧
对于任何RF频率到OP4005B的工作频率。大多数有源环路滤波器采用运算放大器
直接驱动调谐端口时，将是稳定的。特别护理都应该注意避免在从路径接地环路
虽然环路滤波器到OP4005B的调谐输入的相位检测器的输出。对于大多数应用，然而，其带宽
宽度在OP4005B锁相环的环路滤波器将低于50赫兹，如示例中所示OP4005B PLL的申请中所讨论
下面的部分。
配置OP4005B直流输出电压
该OP4005B的各差动输出进行交流耦合，使每个输出端的静态DC电平要与一个电阻设定
分相匹配的逻辑系列驱动的时钟。在每两个电阻的并联的等效电阻
除法器应该是大约50欧姆。电源电压的分压器，V
负载
应该是两到三倍的值
静态直流电压V的
DC
.
参看图5：
V
DC
= V
负载
*R1/(R1 + R2)
和
50 = R1*R2/(R1 + R2)
电阻器R2的值，并
R1是直接给出：
R2 = 50 * V
负载
/V
DC
R1 = 1/(0.02 - (1/R2))
图5
V
TUNE
OP4005B
V
DC
R1
R1
3.3 VDC
OP4005B直流输出电压调节
V
负载
R2
R2
V
DC
负载
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