PEDL7048-01-01
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半导体
ML7048-01
DOUT1 ， DOUT2 ， DOUT3
当P / S是“0”和第3通道的独立的串行接口被选择， DOUT1是将PCM信号输出引脚
通道1 ， DOUT2为通道2 ，和DOUT3为通道3 。
当P / S是“1”和3通道的连续的串行接口被选择， DOUT1是将PCM信号输出引脚
每个信道和数据是在信道1，信道2和信道3的顺序输出这时， DOUT2和
DOUT3都处于高阻抗状态。
对PCM信号依次输出MSD的同步与BCLK的上升开始。 （ MSD可能
是在XSYNC的上升沿输出取决于BCLK和XSYNC的定时。 ）这些引脚是在高
期间的时间比PCM数据输出位之外的阻抗。
这些引脚也都处于高阻抗在掉电模式和省电模式。
必须将这些引脚内部连接到上拉电阻，因为输出形式是漏极开路的。对于编码
法律， ITU -T推荐
μ律
采用。
PCMIN / PCMOUT
μ律
输入/输出电平
M
S
D
1
1
0
0
D
2
0
1
1
0
D
3
0
1
1
0
D
4
0
1
1
0
D
5
0
1
1
0
D
6
0
1
1
0
D
7
0
1
1
0
D
8
0
1
1
0
+满量程
+0
–0
=满量程
表1编码法
VDDA
+ 5V电源为模拟信号电路。
使用的设备中使用的模拟电源系统。
连接的1旁路电容器
µF
具有优良的高频特性和10的电容器
µF
间
这个引脚和AG引脚。
AG
接地引脚的模拟信号电路。
V
DD
+ 5V电源引脚为数字信号的电路。
虽然这个引脚和VDDA没有内部连接，必须将这些引脚连接印刷电路
板。
DG
接地引脚为数字信号的电路。
虽然这个引脚和AG没有内部连接，这些引脚必须连接到印刷电路板上。
的Test2 ， Test3的
这些引脚用于设备测试。
这些器件测试引脚都必须连接到DG引脚。
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