PDSP16318/13618A
符号
A15:0
B15:0
C15:0
D15:0
CLK
CEA
CEB
OEC
OED
OVR
TYPE
输入
输入
产量
产量
输入
输入
输入
输入
输入
产量
描述
数据
呈现给该输入被装入在CLK的上升沿输入寄存器。 A15是MSB。
数据
呈现给该输入被装入在CLK的上升沿输入寄存器。 B15是MSB
并具有相同的权重为A15 。
新
数据
出现在后CLK的上升沿该输出。 C15是MSB。
新
数据
出现在后CLK的上升沿该输出。 C15是MSB。
公共时钟
所有内部寄存器
时钟使能：
当低的时钟输出到A输入寄存器使能。
时钟使能：
当低的时钟B输入寄存器使能。
OUTPUT ENABLE ：
异步三态输出控制：这个C输出为高阻
状态时，此输入为高。
OUTPUT ENABLE ：
异步三态输出控制：对D输出为高阻
状态时，此输入为高。
溢出标志：
该标志将变为高在这期间无论是输出数据溢出人数的周期
选择的范围或任加法结果溢出。新的OVR后出现的上升沿
CLK 。
加/减实：
控制输入为'真正的'加法器。此输入由时钟的上升沿锁存。
加/减的Imag ：
控制输入为'的Imag “加法。此输入由时钟的上升沿锁存。
累加器清除：
普通蓄电池明确两个加法器/减法器单元。此输入由锁存
CLK的上升沿。
MUX选择：
控制输入两个加法器多路复用器。此输入由CLK的上升沿锁存。
当高的反馈路径选择。
缩放控制：
此输入由被路由到输出端的20位加法器的结果选择16位字段。
此输入由CLK的上升沿锁存。
延时控制：
该输入选择延迟输入到实际加法器，用于涉及操作
PDSP16112 。此输入由CLK的上升沿锁存。
+ 5V电源：
双方的Vcc引脚必须连接。
0V电源：
这两个GND引脚都必须连接。
ASR1 ： 0
ASI1 ： 0
CLR
MS
S2:0
DEL
VCC
GND
输入
输入
输入
输入
输入
输入
动力
地
GG销
77
82
83
84
85
86
87
88
89
90
91
92
93
94
95
96
97
98
99
100
5
AC引脚功能GG针AC销
B2
C2
B1
C1
D2
D1
E3
E2
E1
F2
F3
G3
G1
G2
F1
H1
H2
J1
K1
J2
L1
D7
D8
D9
D10
GND
VCC
D11
D12
D13
D14
D15
C15
C14
C13
C12
VCC
GND
C11
C10
C9
C8
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
K2
K3
L2
L3
K4
L4
J5
K5
L5
K6
J6
J7
L7
K7
L6
L8
K8
L9
L10
K9
L11
功能GG针AC销
C7
C6
C5
C4
C3
C2
C1
C0
OED
OEC
S2
S1
S0
MS
ASI1
ASI0
DEL
CLR
ASR1
ASR0
A0
31
32
33
34
35
36
37
38
39
40
41
42
43
44
45
46
47
48
49
50
51
K10
J10
K11
J11
H10
H11
F10
G10
G11
G9
F9
F11
E11
E10
E9
D11
D10
C11
B11
C10
A11
功能GG针AC销
A1
A2
A3
A4
A5
A6
A7
A8
A9
A10
A11
A12
A13
A14
A15
CEA
B15
B14
B13
B12
B11
56
57
58
59
60
61
62
63
64
65
66
67
68
69
70
71
72
73
74
75
76
B10
B9
A10
A9
B8
A8
B6
B7
A7
C7
C6
A6
A5
B5
C5
A4
B4
A3
A2
B3
A1
功能
B10
B9
B8
B7
B6
B5
B4
B3
B2
B1
B0
CLK
CEB
OVR
D0
D1
D2
D3
D4
D5
D6
器件的引脚陶瓷84 - 针PGA （ AC84 ）和陶瓷QFP （ GG100 ）
3
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