MT9125
引脚说明（续）
针＃
DIP
PLCC
初步信息
名字
EN1
描述
通道1输出使能选通。这个输出被从ST总线C4I和F0i解码
信号和它的位置， ST-总线流中，可以经由ENS引脚控制。
参阅图4中所示的ST-总线相对的时序图。
通道2输出使能选通。这个输出被从ST总线C4I和F0i解码
信号和它的位置， ST-总线流中，可以经由ENS引脚控制。
参阅图4中所示的ST-总线时序图。
启用只ST- BUS操作选择输入。此控制引脚改变了ST-总线
EN1和EN2的信道位置，以及ADPCM编码的信道位置。参考ST-
如图4所示。总线时序图。当不使用该引脚应连接到V
DD
。这
是TTL电平输入。
无连接。离开开路。
22
26
23
27
EN2
24
28
ENS
1, 9,
15,
21
NC
功能说明
该双通道ADPCM代码转换器是一种低
电力， CMOS器件能够2编码器
功能和两个解码器功能。 2个64 kbit / s的
PCM信道（PCM octets）被压缩成
两个32千比特/ s的ADPCM通道（ ADPCM的话） ，并
两个32千比特/ s的ADPCM通道（ ADPCM的话）是
扩大到2的64 kbit / s的PCM信道（PCM
八位字节） 。所采用的ADPCM编码转换算法
符合CCITT建议G.721和
ANSI T1.303-1989 。该器件还支持24
千比特/秒（ 3比特字）的算法（CCITT / G.723 ） 。
切换，上的即时， 32千比特/秒和24千比特之间/ s的
可以通过切换适当的模式选择
（ MS1 - MS4 ）控制引脚。
内部电路需要很少的能量，以
操作; 25mW的典型的双信道工作。
的4.096 MHz的主时钟频率要求
该电路完成两个编码信道和
2解码通道。操作与
异步主时钟，相对于8kHz的
参考，是允许的。
该设备的所有可选功能引脚选择，
没有微处理器是必需的。这允许简单的
与行业标准的编解码器，双接口
编解码器，数字电话设备，以及1层
收发器。
对PCM和ADPCM串行总线是
同步串行接口（ SSI ） ，允许串行
时钟速率为128 kHz至2.048兆赫。另外
在设备上引脚允许一个简单的界面给ST-
BUS组件。芯片上的通道计数器提供
通道使能输出，以及一个2.048 MHz的
8-20
时钟输出，用于驱动所述定时输入引脚有用
标准的编解码器设备。
串行I / O端口（ ADPCMi ， ADPCMo ， ENA ， ENB1 ，
ENB2 ， DSTI ， DSTO ， C 20 ， EN1 ， EN2 ， ENS ， F0i ）
串行I / O数据传输的双ADPCM
码器通过PCM和所提供的
ADPCM端口。串行I / O端口的操作是类似的
无论ST- BUS和SSI模式。双ADPCM
代码转换器确定的操作，通过模式
监测施加到F0i引脚上的信号。当一个
有效的ST- BUS帧脉冲（ 244ns低向脉冲）
连接到F0i销的代码转换器将
假设ST- BUS操作。如果F0i不断绑
到V
SS
代码转换器将承担SSI操作。针
在这些模式中的功能性描述
下面的子部分。
ADPCM端口操作（ ADPCMi ， ADPCMo ， ENA ）
该ADPCM端口由ADPCMi ， ADPCMo和
ENA 。 ADPCM的端口的功能是类似的ST-
BUS和SSI的操作，所不同的是在
其中BCLK信号导出并在其中
ADPCM字被放置在8 kHz的范围内。
对于SSI的操作（例如，当F0i不断绑
到V
SS
）的ADPCM码字两个通道都
调过来ADPCMi / ADPCMo的位时钟
率（BCLK ）期间由所定义的信道时间
输入选通在ENA 。请参考图3和图
13.数据被锁存到ADPCMi销与
下降沿BCLK的边缘而输出数据是由
可在ADPCMo在BCLK的上升缘。
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