MT9075B
引脚说明（续）
针＃
名字
PLCC MQFP
初步信息
描述
负电源（输入） 。
数字地。
内部连接。
绑到V
SS
（地）的正常运行。
17
18
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VSS
IC
INT / MOT英特尔/摩托罗拉模式选择（输入） 。
高在此引脚CON组fi居雷什处理器
接口英特尔并行非复用总线类型。低CON科幻居雷什处理器
界面为摩托罗拉平行非多路复用类型。
VDD
D4 - D7
正电源（输入） 。
数字电源（ + 5V
±
5%).
4数据到数据7 （三态I / O） 。
这些信号结合D0 - D3的形成
微处理器接口的双向数据总线（ D7是最显着的一点） 。
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R / W / WR读/写/写选通（输入） 。
在摩托罗拉方式（R / W）时，该输入控制的数据总线D的方向[0：7 ]中
微处理器访问。当R / W为高电平时，并行处理器是读取数据
从MT9075B 。当为低电平时，微处理器将数据写入到MT9075B 。
对于英特尔模式（ WR ） ，该低电平有效写选通网络骗子居雷什的数据总线为
输出。
AC0 -
AC4
地址/控制0 〜4 （输入） 。
地址和控制输入，用于在微处理器
界面。 AC0是最显着的输入。
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8-11
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GNDARx接收模拟接地（输入） 。
模拟地， LIU接收器。
RTIP
RRING
收到TIP和RING （输入） 。
差分输入接收线路信号 - 必须是
变压器耦合（参见图4） 。
正电源（输入） 。
数字电源（ + 5V
±
5%).
负电源（输入） 。
数字地。
内部连接。
必须悬空的正常运行。
内部连接。
必须悬空的正常运行。
VDDARx接收模拟电源（输入） 。
模拟电源LIU接收器（ + 5V
±
5%).
VDD
VSS
IC
IC
RxDLCLK接收数据链路时钟（输出） 。
从2.048 Mbit / s的衍生间隙时钟信号
时钟，可用于外部设备的时钟在RxDL数据（ 4 ，8，12 ， 16或20 kHz）的上
上升沿。
RXDL
TxMF
接收数据链路（输出） 。
收到包含数据线一2.048 Mbit / s的数据流
经过HDB3解码。该数据时钟输出与E2o的上升沿。
发送多帧边界（输入） 。
所使用的有源低输入可设置发送
多帧边界（ CAS或CRC复帧） 。该MT9075B将产生其自己的
多帧，如果该引脚为高电平。此输入通常拉高于大多数应用。
接收多帧边界（输出） 。
输出脉冲限定接收到的
复帧的边界。上的数据流（ DSTO ）在下一帧输出是基本帧
零上30 PCM链路。这个接收多帧信号可以与任一
收到的CRC复帧（页01H ，地址10H，位6 ， MFSEL = 1）或接收
信令复帧（ MFSEL = 0）。
系统总线同步/同步线选择（输入） 。
如果高， C4b的和F0B
将输入;如果低， C4b的和F0B将输出。
2.048 MHz的提取时钟（输出） 。
从接收信号中提取的时钟
并在内部使用的时钟在RTIP和RRING接收到的数据。
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41
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23
RxMF
43
44
24
32
BS / LS
E2o
4
MITEL [ MITEL NETWORKS CORPORATION ]
