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MT90221AL 参数 Datasheet PDF下载

MT90221AL图片预览
型号: MT90221AL
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内容描述: 四IMA / UNI PHY设备 [Quad IMA/UNI PHY Device]
分类和应用: 电信集成电路异步传输模式ATM
文件页数/大小: 114 页 / 304 K
品牌: MITEL [ MITEL NETWORKS CORPORATION ]
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MT90221
VSS
PLLREF_0
PLLREF_1
TEST3
TEST4
DSTI_0
RXSYNCI_0
VDD
RXCKI_0
VSS
RXCKI_1
DSTI_1
RXSYNCI_1
DSTI_2
RXSYNCI_2
VSS
RXCKI_2
VDD
RXCKI_3
VSS
DSTI_3
RXSYNCI_3
NC
NC
VSS
NC
VDD
NC
VDD
NC
NC
NC
NC
VSS
NC
VDD
NC
VSS
NC
NC
DSTO_0
TXSYNCIO_0
VDD
TXCKIO_0
VSS
TXCKIO_1
VDD
DSTO_1
TXSYNCIO_1
DSTO_2
TXSYNCIO_2
VSS
156 154 152 150 148 146 144 142 140 138 136 134 132 130 128 126 124 122 120 118 116 114 112 110 108 106
158
102
160
100
162
98
164
96
166
94
168
92
170
90
172
88
174
86
176
84
178
82
180
80
182
184
186
74
188
72
190
70
192
68
194
66
196
64
198
62
200
60
202
58
204
56
206
54
208
2
4
6
8
10
12
14
16
18
20
22
24
26
28
30
32
34
36
38
40
42
44
46
48
50
52
104
VSS
REFCK_3
REFCK_2
REFCK_1
REFCK_0
SR_A_18
SR_A_17
SR_A_16
SR_A_15
SR_A_14
VDD
VSS
SR_A_13
SR_A_12
SR_A_11
SR_A_10
VDD
VSS
SR_A_9
SR_A_8
SR_A_7
SR_A_6
SR_A_5
VDD
VSS
SR_A_4
SR_A_3
SR_A_2
SR_A_1
SR_A_0
sr_we
SR_D_7
SR_D_6
SR_D_5
SR_D_4
SR_D_3
VDD
VSS
SR_D_2
SR_D_1
SR_D_0
SR_CS 1
SR_CS_0
VSS
VDD
RxSOC
RxClav
VDD
RXDATA_7
RXDATA_6
RXDATA_5
VSS
208引脚MQFP
78
76
VSS
TXCKIO_2
VDD
TXCKIO_3
VSS
DSTO_3
TXSYNCIO_3
NC
NC
VSS
NC
VDD
NC
VSS
NC
NC
NC
NC
VDD
NC
VSS
NC
VDD
NC
NC
VSS
VDD
TEST2
TEST1
VDD
CLK
VSS
TCK
TMS
TDI
TRST
TDO
up_irq
VDD
UP_A_0
UP_A_1
UP_A_2
UP_A_3
UP_A_4
UP_A_5
UP_A_6
UP_A_7
UP_A_8
UP_A_9
UP_A_10
RESET
VSS
引脚说明
针#
名字
I / O
描述
ATM输入端口的信号(发送UTOPIA接口)
22, 23,
24, 25, 26,
27, 28, 29
21
TXDATA
[7:0]
TxSOC
I
UTOPIA发送数据总线。
从ATM层设备驱动,以字节级数据
MT90221 。位7是MSB。先前的最后一个字节之间的所有到达的数据
细胞与以下细胞(由SOC的信号表示)的网络连接第一个字节被忽略。
UTOPIA发送启动细胞信号。
由ATM持有效的高电平信号
[7:0 ]中包含的小区的网络连接第一个有效字节时TXDATA层设备。在此之后
信号为高时,以下52个字节应包含有效数据。该MT90221等待
用于读出一个完整的信元之后的另一TxSOC信号。
3
VDD
VSS
RXADDR_4
RXADDR_3
RXADDR_2
RXADDR_1
RXADDR_0
VDD
RXCLK
VSS
RXENB
VDD
VSS
TX_CLAV
TxSOC
TXDATA_7
TXDATA_6
TXDATA_5
TXDATA_4
TXDATA_3
TXDATA_2
TXDATA_1
TXDATA_0
TXENB
VDD
TXCLK
VSS
TXADDR_4
TXADDR_3
TXADDR_2
TXADDR_1
TXADDR_0
up_cs
up_oe
UP_RW
VSS
VDD
UP_D_7
UP_D_6
UP_D_5
UP_D_4
UP_D_3
UP_D_2
UP_D_1
UP_D_0
VSS
VSS
RXDATA_4
RXDATA_3
RXDATA_2
RXDATA_1
RXDATA_0
图2 - 引脚连接
I