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MT8952图片预览
型号: MT8952
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内容描述: ISO- CMOS ST- BUS⑩家庭HDLC协议控制器 [ISO-CMOS ST-BUS⑩ FAMILY HDLC Protocol Controller]
分类和应用: 控制器
文件页数/大小: 22 页 / 370 K
品牌: MITEL [ MITEL NETWORKS CORPORATION ]
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ISO- CMOS
传入的​​ST- BUS ( CDSTi )期间的时隙
该协议控制器的内部计时模式。
MT8952B
当数据被发送FIFO中检测到,则
协议控制器将继续在以下任一
方式:
如果发射机处于空闲状态时,本字节
传输完成8 1和
然后是一个开始FL股份公司,并随后
在发送FIFO的数据被传送。
如果变送器在帧间的时间科幻LL状态,
目前正在传输的FL公司是网络nished
然后又开始FL公司之前发射
从发送FIFO传输数据。
如果变送器处于前进状态,它继续
在即使在数据被加载到该状态
FIFO中。只有当IFTF位被设置为
选择的东西比继续将其它的
数据被发送。
如果变送器是透明的数据传输状态,
该协议的功能被禁用,数据
在发送FIFO传送的CDSTo 。
以指示该特定字节是最后字节
该数据包,在控制寄存器中的EOP位必须
之前的最后一个字节被写入发送设定
FIFO。该EOP位时自动清零
数据字节被写入到FIFO 。后
的最后一个字节的数据包中发送,该帧
检查序列(16位)被发送之后是
关闭FL AG 。如果在发送任何更多数据
FIFO ,另一FL公司被传输后新
数据。的情况下,在FIFO中没有数据时,发射器
假设所选择的链路信道状态。在
数据或者帧校验的传输
序,该协议控制器检查
由位的基础上发送信息了一下,
插入一个0网络的每一个序列之后,已经
连续的。
发送FIFO满:
当发送FIFO满时,这种状态表示
由FIFO状态的发送FIFO状态位
注册。这些位不改变状态的2位
经过FIFO的从任一接入周期
串行端口或微处理器端口。位周期
由CKI信号频率来确定。如果总线
控制微处理器的周期是多少
比位周期越短,则发送FIFO状态
位可能并不在时间为下一个被更新
微处理器读取FIFO状态寄存器。
确保微处理器不
覆盖的Tx FIFO ,如果超过4个字节
信息被写入Tx FIFO中,
3-71
RESET
当MT8952B由低向脉冲时复位
RST引脚或通过设置(高电平)的RST位
该定时控制寄存器,该设备被放入
以下状态:
a)在该定时控制寄存器中的所有位都被清除
(逻辑0 ),外部复位。内部复位
清除除RST位的所有位。
b)在中断所有位使能寄存器是
清零(逻辑0 ) 。
c)在控制寄存器的所有位被清零(逻辑
0).
d)在中断寄存器所有位清零(逻辑
0).
e)在常规状态寄存器的所有位被清零
(逻辑0 ),除了两个最显着的位。
F)接收和发送寄存器被清零,
FIFO的状态寄存器重新佛罗里达州ECTS其状态
因此。
G)的WD输出低电平复位由外部复位
但不会影响内部复位。
h)本发射器和接收器都被禁止。
发送操作
复位,之后,外部电路应
提供在通电时,发射部分是
禁用。在启用这一节,定时
应设置。上电复位时,串行端口设置为
外部时钟模式。在情况下,这是不希望的,则
定时控制寄存器应写入与
相应的数据。一旦在正确的定时模式,
在控制的发送使能( TXEN )位
寄存器可以设置。现在,该发射机是
使这将是在空闲的信道状态。如果有任何
其他的信道状态或透明的数据传输
设施是必需的, IFTF位在控制
注册应进行相应的设置。
正常报文:
启动一个数据包时,数据被写入到发送
FIFO起始地址连接的场。所有的数据
必须被写入FIFO中的一个单字节宽的方式。