24AA64/24LC64/24FC64
7.0
引脚说明
的引脚说明如表7-1所示。
表7-1：
名字
A0
A1
A2
V
SS
SDA
SCL
WP
V
CC
引脚功能表
PDIP
1
2
3
4
5
6
7
8
SOIC
1
2
3
4
5
6
7
8
TSSOP
1
2
3
4
5
6
7
8
DFN
1
2
3
4
5
6
7
8
MSOP
1
2
3
4
5
6
7
8
描述
芯片地址输入
芯片地址输入
芯片地址输入
地
串行地址/数据I / O
串行时钟
写保护输入
+ 1.7V至5.5V电源
7.1
A0 ， A1 ， A2芯片地址输入
7.3
串行时钟（ SCL ）
时，A0 ，A1和A2的输入所使用的24XX64为
多个设备的操作。在这些输入的电平
与从器件的对应位进行比较
地址。该芯片被选中，如果比较结果为true 。
多达八个设备可被连接到相同的总线
通过使用不同的片选位的组合。这些
输入必须连接到无论是V
CC
或V
SS
.
在大多数应用中，该芯片的地址输入端A0 ， A1
和A2是硬连接到逻辑“0”或逻辑“1” 。为
在这些引脚由一个控制应用程序
微控制器或其它可编程设备，所述芯片
地址引脚必须驱动为逻辑“0”或逻辑“1”
前器件正常工作可以继续进行。
SCL输入用于同步的数据传输
从和到设备。
7.4
写保护（WP ）
该引脚必须连接到无论是V
SS
或V
CC
。如果绑
到V
SS
，写操作被使能。如果连接到V
CC
,
写操作被禁止，但读操作
不受影响。
7.2
串行数据（ SDA ）
SDA是用来传送地址的双向引脚
和数据移入和移出器件。因为它是一个开
漏极端子， SDA总线需要一个上拉电阻
到V
CC
（典型值10 kΩ的100千赫， 2 kΩ的400千赫） 。
在正常传输数据， SDA允许改变
仅在SCL为低电平。在SCL为高电平变化
用于指示启动和停止条件保留。
DS21189L第12页
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