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    ML2037 参数 Datasheet PDF下载

    ML2037图片预览
    型号： ML2037
    PDF下载： 下载PDF文件 查看货源
    内容描述： 为500kHz ，串行输入，可编程正弦波发生器与数字增益控制 [500kHz, Serial Input, Programmable Sine Wave Generator with Digital Gain Control]
    分类和应用：
    文件页数/大小： 10 页 / 211 K
    品牌： MICRO-LINEAR [ MICRO LINEAR CORPORATION ]
     浏览型号ML2037的Datasheet PDF文件第1页浏览型号ML2037的Datasheet PDF文件第2页浏览型号ML2037的Datasheet PDF文件第3页浏览型号ML2037的Datasheet PDF文件第5页浏览型号ML2037的Datasheet PDF文件第6页浏览型号ML2037的Datasheet PDF文件第7页浏览型号ML2037的Datasheet PDF文件第8页浏览型号ML2037的Datasheet PDF文件第9页  
    ML2037
    电气特性
    符号
    振荡器
    （续）
    t
    R
    t
    F
    逻辑
    V
    IL
    V
    IH
    I
    IL
    I
    IH
    V
    OL
    V
    OH
    f
    S
    CLK
    （续）
    条件
    民
    典型值
    最大
    单位
    参数
    CLK输出上升时间
    CLK OUT下降时间
    C
    L
    = 25PF ，见时序图2
    C
    L
    = 25PF ，见时序图2
    8
    8
    ns
    ns
    输入低电压
    输入高电压
    输入低电平电流
    输入高电流
    输出低电压
    输出高电压
    串行时钟频率
    串行时钟脉冲宽度
    s的数据建立时间
    s的数据保持时间
    S启用设置时间
    S使能保持时间
    从s延迟使能以稳定的输出
    从延迟到SYNC输出开始
    f
    CLK IN
    = 32MHz的
    f
    CLK IN
    = 32MHz的
    I
    OL
    = -2mA
    I
    OH
    = 2毫安
    4.0
    0.01
    40
    10
    10
    30
    50
    500
    500
    DV
    CC
    - 1
    -1
    1.0
    V
    V
    µA
    1
    0.4
    µA
    V
    V
    10
    兆赫
    ns
    ns
    ns
    ns
    ns
    ns
    ns
    t
    PW
    t
    SSD
    t
    HSD
    t
    SSENS
    t
    SSENH
    t
    DSEN
    t
    DSYNC
    供应
    AI
    CC
    AV
    CC
    当前
    f
    CLK IN
    = 16MHz时
    f
    CLK IN
    = 32MHz的
    SHDN = 5V
    35
    40
    45
    50
    10
    mA
    mA
    µA
    mA
    mA
    µA
    DI
    CC
    DV
    CC
    当前
    f
    CLK IN
    = 16MHz时
    f
    CLK IN
    = 32MHz的
    SHDN = 5V
    10
    16
    14
    20
    30
    注1 ：
    限制是由100％的测试，取样，或者相关性与最坏情况下的测试条件的保证。
    t
    PW
    S CLK
    t
    SSD
    S数据
    t
    HSD
    D0
    t
    SSENS
    S启用
    D1
    D2
    D14
    D15
    t
    SSENH
    t
    PW
    时序图1 。
    f
    CLK IN
    CLK IN
    f
    CLK出
    CLK出
    t
    R
    t
    F
    时序图2 。
    4

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