EDI8L32512V
FIGURE 7 – INTERFACING THE ANALOG SHARC DSP WITH THE EDI8L32512V (1M X 48 ARRAY)
EDI8L32512V
(Configured as 1Mx16)
A18-0
E0#
E1#
E2#
E3#
W#
D
DQ31
A
T
A
DQ15
Address Bus
A31- 0
DQ16
DQ15
WORD1
DQ0
MS0#
MS1#
B
U
S
DQ0
G#
WR#
RD#
EDI8L32512V
(Configured as 1Mx16)
D
A
T
A
DQ31
A18-0
E0#
E1#
E2#
E3#
W#
DQ31
Analog Device
ADSP-2106xL
DQ16
DQ15
WORD2
DQ16
B
U
S
DQ0
G#
EDI8L32512V
(Configured as 1Mx16)
D
DQ31
A18-0
E0#
E1#
E2#
E3#
W#
A
T
A
DQ47
DQ16
DQ15
WORD3
DQ17
Databus
D47-0
B
U
S
DQ0
G#
FIGURE 8 – MCM-L UPGRADE PATH
8L32512V
8L32256V
512Kx32
256Kx32
128Kx32
8L32128V
DQ17
60
59
58
57
56
55
54
53
52
51
50
49
48
47
46
45
44
DQ14 DQ14
DQ13 DQ13
DQ12 DQ12
DQ17 DQ17
DQ18 DQ18
DQ19 DQ19
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
DQ14
DQ13
DQ12
VSS
DQ11
DQ10
DQ09
DQ08
VCC
DQ07
DQ06
DQ05
DQ04
VSS
DQ03
DQ02
DQ01
DQ18
DQ19
VSS
DQ20
DQ21
DQ22
DQ23
VCC
DQ24
DQ25
DQ26
DQ27
VSS
DQ28
DQ29
DQ30
VSS
VSS
VSS
VSS
DQ11 DQ11
DQ10 DQ10
DQ09 DQ09
DQ08 DQ08
DQ20 DQ20
DQ21 DQ21
DQ22 DQ22
DQ23 DQ23
VCC
VCC
VCC
VCC
DQ07 DQ07
DQ06 DQ06
DQ05 DQ05
DQ04 DQ04
DQ24 DQ24
DQ25 DQ25
DQ26 DQ26
DQ27 DQ27
VSS
VSS
VSS
VSS
DQ03 DQ03
DQ02 DQ02
DQ01 DQ01
DQ28 DQ28
DQ29 DQ29
DQ30 DQ30
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