LF43891 参数 Datasheet PDF下载

型号：	LF43891
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内容描述：	9× 9位数字滤波器 [9 x 9-bit Digital Filter]
分类和应用：
文件页数/大小：	11 页 / 81 K
品牌：	LOGIC [ LOGIC DEVICES INCORPORATED ]

LF43891

设备公司

9× 9位数字滤波器

信号定义

动力

和GND

+ 5V电源。所有引脚必须

连接。

时钟

ABLE

DCM1

ECIMATION

ODE

选举

抽取功能

抽取寄存器未使用

使用的一个抽选寄存器（抽取由二分之一）

用了两个抽取寄存器（抽取了三分之一）

使用了三个抽取寄存器（通过抽取四分之一）

和

DCM0

ABLE

抹去

EGISTER

CCUMULATOR

LEARING

CLK - 主时钟

CLK的上升沿选通所有

寄存器。所有时序规格

参考CLK的上升沿。

输入

DIN

8-0

- 数据输入

9比特的数据被锁存到X寄存器

每个滤波单元的同时。该

DIENB信号使装载

数据。

CIN

8-0

- 系数输入

9位系数被锁存到C

过滤单元0。 CIENB寄存器

信号使负载coeffi-的

cients 。

输出

SUM

25-0

- 数据输出

来自个体的26位结果

过滤器单元时会出现不良反应

2-0

用于选择所述滤波单元的结果。

SHADD与ADR结合

2-0

用于选择从输出

移位和相加输出级。

COUT

8-0

- 产出系数

从9位输出系数

过滤器单元7可被连接到所述

CIN

8-0

系数相同的输入

LF43891再循环的系数。

COUT

8-0

也可以连接到

CIN

8-0

另一LF43891级联

的设备。该COENB信号

使系数的输出。

RESET

结算影响

所有累加器和所有寄存器清零

仅由ADR2-0寻址累加器被清零

所有寄存器清零（累加器不清零）

没有清算时，内部状态保持不变

输出级的说明

中所含的26位的加法器

输出级可以添加的内容

任何过滤单元累加器（通过选择

ADR

2-0

）与18最显著

输出缓冲器的比特。其结果是

存储回的输出缓冲区。

整个操作只需一

时钟周期。八个至少显著

输出缓冲器的比特被丢失。

零多路复用器由控制

该SHADD输入信号。这使得

选择的无论是18最显

输出缓冲器或全部着位

零的加法器的输入。当

SHADD为低电平时，所有的零会

选择。当SHADD为高电平时，

输出的18个最显著位

缓冲区选择使SHIFT-

和相加操作。 SHADD是

锁和一个内部延迟

时钟周期。

输出多路转换器也CON-

由SHADD输入信号进行控制。

这允许选择一个过滤器的

电池蓄能器，通过ADR选择

2-0

或输出缓冲要被输出到

总和

25-0

总线。只有至少26

从任一个滤波单元显著位

蓄能器或输出缓冲器的

在SUM输出

25-0

。如果SHADD是

在连续两个时钟低电平

在当前循环（低和

先前时钟周期）时，输出

多路开关选择的内容

过滤单元蓄电池处理了

ADR

2-0

。否则，该输出

多路选择的内容

输出缓冲器。

如果相同的地址保留在

ADR

2-0

输入用于一个以上的时钟

周期， SUM

25-0

不会改变到

反映任何更新的解决

电池蓄能器。只从结果

第一选择的小区（第一时钟

周期），将被输出。这允许

慢速存储设备接口

当输出必须是有源

对于一个以上的时钟周期。正常

FIR操作不受影响，因为

ADR

2-0

依次改变。

数字系统

数据和系数可以是表象

sented因为无论是8位无符号或9位

2的补码数。所有

值被表示为9位的二

内补数。如果

最显著或符号位为

零，乘法器可以乘8位

无符号数。

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