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GAL22LV10D-4LJ 参数 Datasheet PDF下载

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型号: GAL22LV10D-4LJ
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内容描述: 低压E2CMOS PLD通用阵列Logic⑩ [Low Voltage E2CMOS PLD Generic Array Logic⑩]
分类和应用:
文件页数/大小: 18 页 / 218 K
品牌: LATTICE [ LATTICE SEMICONDUCTOR ]
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特定网络阳离子
GAL22LV10
输出逻辑宏单元( OLMC )
该GAL22LV10具有可变数目的每乘积项
OLMC 。十个可用的OLMCs ,二OLMCs访问
8乘积项(引脚17和27 ) ,二者有10项产品
(引脚18和26 ) ,二者有12项产品(引脚19和25 ) ,
2有14个乘积项(销20和24) ,和两个OLMCs
有16项产品(引脚21和23) 。除了
可用于逻辑乘积项,每个OLMC有一个附加
产品长期致力于输出使能控制。
每个OLMC的输出极性可单独编程
是真还是反转,在任何组合或注册模式。
这允许每个输出被单独配置为
高电平或低电平有效。
该GAL22LV10有一个产品期限为异步重置( AR )
和一个乘积项为同步预置(SP)。这两个
产品条款适用于所有注册OLMCs 。在异步
异步的复位将所有寄存器设为零,任何时候这个专用
乘积项被置位。同步预置设定所有稳压
存器到逻辑1的下一个时钟脉冲的上升沿后
该产品期限为有效。
注: AR和SP产品条款将迫使Q输出
触发器的极性变成相同的状态,而不管
输出。因此,在复位操作,这将寄存器输出
到零,可能会导致无论是高或低,在输出引脚
取决于所选择的引脚的极性。
A R
D
Q
CLK
SP
Q
4到1
MUX
2比1
MUX
GAL22LV10输出逻辑宏单元( OLMC )
输出逻辑宏单元配置
每个GAL22LV10的大电池具有两个主要功能
tional模式:注册,和组合的I / O 。该模式和
的输出的极性是由两个比特(SO和S1 ),它们是去甲设置
马利由逻辑编译器进行控制。这些两个主要的
模式,并且需要使它们的位设置,描述
下面和下页。
注册
在注册模式下,输出引脚与个人相关的
OLMC是由OLMC的D型触发器的Q输出驱动。
在销的输出信号的逻辑极性可以通过选择
指定输出缓冲区驱动或者真(高电平有效)或
倒置(低有效)。输出三态控制可作为IN-
个别的乘积项为每个OLMC ,并因此可以被去
由逻辑方程罚款。该D触发器的/ Q输出被反馈
入与门阵列,同时与真实的补
反馈可以作为输入的AND阵列。
注:在注册模式下,反馈是的/ Q输出
寄存器,并且不从销;因此,一个销定义为
注册是唯一的一个输出端,并且不能用于动态
I / O ,如可以在组合引脚。
组合I / O
在组合模式下的引脚与个人相关的OLMC
由加和项门的输出驱动。的逻辑极性
在引脚输出信号可以通过指定被选择的
输出缓冲器驱动器要么真(高电平有效)或反转(低电平有效) 。
输出三态控制可作为一个单独的产品,长期
对于每个输出,并且可以单独地由编译器如
任一“开” (专用输出), “关”(专用输入) ,或“产品 -
长期驱动“ (动态I / O) 。反馈到与阵列从
输出引脚端启用缓存。两极(真实
销的反相)被反馈到与阵列。
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