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GAL16V8B-25LJI 参数 Datasheet PDF下载

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型号: GAL16V8B-25LJI
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内容描述: 高性能E2CMOS PLD通用阵列逻辑 [High Performance E2CMOS PLD Generic Array Logic]
分类和应用: 可编程逻辑器件输入元件时钟
文件页数/大小: 23 页 / 395 K
品牌: LATTICE [ LATTICE SEMICONDUCTOR ]
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特定网络阳离子
GAL16V8
注册方式
在注册的模式,宏单元被配置为专用
注册输出或I / O功能。
在这种模式下可用的建筑结构与
常见16R8和16RP4设备与各种排列
极性, I / O和寄存器位置。
所有注册的宏单元共享公共时钟和输出使能
控制引脚。任何宏小区可以被配置为注册或
I / O 。多达八个寄存器或最多8个I / O是可能在本
模式。专用的输入或输出功能,可以实现
作为I / O功能的子集。
注册产出的人均产出八大产品条款。 I / O的
有每个输出7乘积项。
在JEDEC熔丝号,包括用户电子签名
( UES )熔丝和乘积项禁止( PTD )融合,是
以下页面上的逻辑图如图所示。
CLK
注册配置注册模式
- SYN = 0 。
- AC0 = 1 。
- XOR = 0定义低电平有效输出。
- XOR = 1定义高电平输出。
- AC1 = 0这个定义输出配置。
- 引脚1控制常见的CLK为注册输出。
- 引脚11控制共同OE为注册输出。
- 引脚1 & 11脚被永久设置为CLK &
OE 。
D
Q
Q
XOR
OE
组合配置的注册方式
- SYN = 0 。
- AC0 = 1 。
- XOR = 0定义低电平有效输出。
- XOR = 1定义高电平输出。
- AC1 = 1这个定义输出配置。
- 引脚1 & 11脚被永久设置为CLK &
OE 。
XOR
注:开发软件会自动配置所有的建筑控制位,并检查适当的引脚使用。
3-68
1996年数据手册