IBMB6M16734JGA
16Mx72 One Bank Registered DDR SDRAM Module
Preliminary
16Mx72 ECC DDR Registered SDRAM DIMM Block Diagram
(1 Bank, x8 DDR SDRAMs)
RS0
DQS0
DM0/DQS9
DQ0
DQ1
DQ2
DQ3
DQ4
DQ5
DQ6
DQ7
DM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
CS
DQS
DQ32
DQ33
DQ34
DQ35
DQ36
DQ37
DQ38
DQ39
DQS4
DM4/DQS13
D0
DM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
CS
DQS
D4
DQS1
DM1/DQS10
DQ8
DQ9
DQ10
DQ11
DQ12
DQ13
DQ14
DQ15
DM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
CS DQS
DQS5
DM5/DQS14
D1
DQ40
DQ41
DQ42
DQ43
DQ44
DQ45
DQ46
DQ47
DM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
CS DQS
D5
DQS2
DM2/DQS11
DQ16
DQ17
DQ18
DQ19
DQ20
DQ21
DQ22
DQ23
DM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
CS
DQS
DQS6
DM6/DQS15
D2
DQ48
DQ49
DQ50
DQ51
DQ52
DQ53
DQ54
DQ55
DM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
CS
DQS
D6
DQS3
DM3/DQS12
DQ24
DQ25
DQ26
DQ27
DQ28
DQ29
DQ30
DQ31
DM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
CS
DQS
DQS7
DM7/DQS16
D3
DQ56
DQ57
DQ58
DQ59
DQ60
DQ61
DQ62
DQ63
DM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
CS DQS
D7
DQS8
DM8/DQS17
CB0
CB1
CB2
CB3
CB4
CB5
CB6
CB7
DM
I/O 0
I/O 1
I/O 2
I/O 3
I/O 4
I/O 5
I/O 6
I/O 7
CS
DQS
Serial PD
SCL
D8
WP
A0
A1
A2
SA0 SA1 SA2
SDA
V
DDQ
V
DD
VREF
V
SS
V
DDID
D0- D8
D0-D8
D0-D8
D0-D8
Strap: see Note 4
S0
BA0-BA1
A0-A11
RAS
CAS
CKE0
WE
PCK
PCK
R
E
G
I
S
T
E
R
RS0 -> CS: SDRAMs D0-D8
RBA0-RBA1 -> BA0-BA1: SDRAMs D0-D8
RA0-RA11 -> A0-A11: SDRAMs D0-D8
RRAS -> RAS: SDRAMs D0-D8
RCAS -> CAS: SDRAMs D0-D8
RCKE0 -> CKE: SDRAMs D0- D8
RWE -> WE: SDRAMs D0-D8
CK0, CK0 --------- PLL*
RESET
* Wire per Clock Loading Table/Wiring Diagrams
Notes:
1. DQ-to-I/O wiring may be changed within a
byte.
2. DQ/DQS/DM/CKE/CS relationships are
maintained as shown.
3. DQ/DQS resistors are 22 Ohms.
4. VDDID strap connections (for memory
device VDD, VDDQ):
STRAP OUT (OPEN): VDD = VDDQ
STRAP IN (VSS): VDD
≠
VDDQ.
5. SDRAM placement alternates between the
back and front sides of the DIMM.
6. Address and control resistors are 22 Ohms.
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