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C5ENPA1-DS/D

Rev 03

LIST OF FIGURES

Freescale Semiconductor, Inc...

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C-5e Network Processor Block Diagram.

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Pin Locations (Top View)

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Pin Locations (Bottom View)

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GMII/TBI Transmit and Receive Pin Configurations

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PROM Interface Diagram

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PROM Interface Timing Outline

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Observe-Only Cell

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Cell Design That Can Be Used for Both Input and Output Pins

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Bringup Clock Timing Diagram

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Package Cross Section View with Several Heat Sink Options.

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Package with Heat Sink Mounted to the Printed Circuit Board.

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Test Loading Conditions.

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System Clock Timing Diagram

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DS1/DS3 Ethernet Timing Diagram

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10/100 Ethernet Timing Diagram

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Gigabit Ethernet and TBI Interface Timing Diagram

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OC-3 Timing Diagram

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OC-12 Timing Diagram

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PCI Timing Diagram

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MDIO Serial Interface Timing Diagram

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Low Speed Serial Interface Timing Diagram

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PROM Interface Timing Diagram

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Fabric Processor Timing Diagram

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BMU Timing Diagram

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TLU Timing Diagram

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QMU SRAM (Internal Mode) Timing Diagram

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QMU to Q-5 (External Mode) Timing Diagram

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C-5e Network Processor BGA Package Side View

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C-5e Network Processor BGA Package (Bottom View)

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C-5e Network Processor BGA Package (Top View)

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