Freescale Semiconductor, Inc.
Table of Contents
Section 3. Pinout and Signal Descriptions
3.1
Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .37
Pin Assignments in 112-pin QFP . . . . . . . . . . . . . . . . . . . . . . .37
Power Supply Pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .40
Signal Descriptions. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .42
Port Signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .51
3.2
3.3
3.4
3.5
Section 4. Registers
4.1
4.2
Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .63
Register Block. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .63
Section 5. Operating Modes
5.1
5.2
5.3
5.4
5.5
5.6
Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .75
Introduction. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .75
Operating Modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .75
Background Debug Mode. . . . . . . . . . . . . . . . . . . . . . . . . . . . .78
Internal Resource Mapping. . . . . . . . . . . . . . . . . . . . . . . . . . . .81
Memory Maps. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .93
Section 6. Bus Control and Input/Output
6.1
6.2
6.3
6.4
Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .95
Introduction. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .95
Detecting Access Type from External Signals . . . . . . . . . . . . .95
Registers. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .96
Section 7. Flash Memory
7.1
7.2
Contents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .107
Introduction. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .107
Technical Data
MC68HC912DG128 — Rev 3.0
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