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EBD12UB8ALF-75 参数 Datasheet PDF下载

EBD12UB8ALF-75图片预览
型号: EBD12UB8ALF-75
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内容描述: 128MB无缓冲DDR SDRAM DIMM [128MB Unbuffered DDR SDRAM DIMM]
分类和应用: 存储内存集成电路动态存储器双倍数据速率时钟
文件页数/大小: 16 页 / 160 K
品牌: ELPIDA [ ELPIDA MEMORY ]
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EBD12UB8ALF  
Byte No. Function described  
95 to 98 Module serial number  
Bit7 Bit6 Bit5 Bit4 Bit3 Bit2 Bit1 Bit0 Hex value  
Comments  
99 to 127 Manufacture specific data  
Block Diagram  
/CS0  
RS  
RS  
RS  
RS  
RS  
RS  
RS  
RS  
RS  
DM0/DQS9  
DM1/DQS10  
DM2/DQS11  
DM3/DQS12  
DM4/DQS13  
DM5/DQS14  
DM6/DQS15  
DM7/DQS16  
DQS0  
DQS  
DQ  
/CS DM  
RS  
RS  
8
8
8
8
8
8
8
8
DQ0 to DQ7  
DQS1  
D0  
DQS  
DQ  
/CS DM  
RS  
RS  
DQ8 to DQ15  
DQS2  
D1  
DQS  
DQ  
/CS DM  
RS  
RS  
DQ16 to DQ23  
DQS3  
D2  
DQS  
DQ  
/CS DM  
RS  
RS  
DQ24 to DQ31  
DQS4  
D3  
DQS  
DQ  
/CS DM  
RS  
RS  
DQ32 to DQ39  
DQS5  
D4  
DQS  
DQ  
/CS DM  
RS  
RS  
DQ40 to DQ47  
DQS6  
D5  
DQS  
DQ  
/CS DM  
RS  
RS  
DQ48 to DQ55  
DQS7  
D6  
DQS  
DQ  
/CS DM  
RS  
DQ56 to DQ63  
D7  
A0 to A11  
BA0, BA1  
/RAS  
A0 to A11 (D0 to D7)  
* D0 to D7: EDD1208ALTA  
U0: 2k bits EEPROM  
RS: 22  
BA0, BA1 (D0 to D7)  
/RAS (D0 to D7)  
/CAS (D0 to D7)  
/WE (D0 to D7)  
/CAS  
/WE  
VDD, VDDQ  
VREF  
D0 to D7  
D0 to D7  
D0 to D7  
CKE0  
CKE (D0 to D7)  
VSS  
Serial PD  
SCL  
VDDID  
open  
SCL  
SDA  
SDA  
U0  
Clock wiring  
Clock input  
DDR SDRAMS  
A0  
A1  
A2  
CLK0, /CLK0 2DRAM loads  
CLK1, /CLK1 3DRAM loads  
CLK2, /CLK2 3DRAM loads  
SA0 SA1 SA2  
Notes:  
1. The SDA pull-up resistor is required due to  
the open-drain/open-collector output.  
2. The SCL pull-up resistor is recommended  
because of the normal SCL line inacitve  
"high" state.  
Note: Wire per Clock loading table/Wiring diagrams.  
Preliminary Data Sheet E0216E10 (Ver. 1.0)  
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