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CY7C4225-15AC 参数 Datasheet PDF下载

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型号: CY7C4225-15AC
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内容描述: 64 , 256 , 512 , 1K , 2K , 4K ×18同步FIFO [64, 256, 512, 1K, 2K, 4K x 18 Synchronous FIFOs]
分类和应用: 存储内存集成电路先进先出芯片时钟
文件页数/大小: 25 页 / 411 K
品牌: CYPRESS [ CYPRESS SEMICONDUCTOR ]
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1CY 7C42 25
传真号: 5410
CY7C4425/4205/4215
CY7C4225/4235/4245
64 , 256 , 512 , 1K , 2K , 4K ×18同步FIFO
特点
•高速,低功耗,先入先出( FIFO )
回忆
• 64 ×18 ( CY7C4425 )
• 256 ×18 ( CY7C4205 )
• 512 ×18 ( CY7C4215 )
• 1K ×18 ( CY7C4225 )
• 2K ×18 ( CY7C4235 )
• 4K ×18 ( CY7C4245 )
•高速100 MHz工作频率( 10 ns的读/写周期
时间)
•低功耗(I
CC
= 45 mA)的
•完全异步和同步读写
手术
•空,满,半满,可编程几乎
空/几乎满状态标志
• TTL兼容
•重传功能
•输出使能( OE )引脚
•独立的读写使能引脚
•中心电源和接地,可降低噪音
•支持自由运行的50%占空比的时钟输入
•宽度扩展能力
•深度扩展能力
•节省空间的64引脚TQFP 10×10 , 14×14和TQFP
- 68引脚PLCC
通过一个自由运行的时钟( WCLK )和写使能控制
销( WEN) 。
当文被声明时,数据被写入到FIFO的
在WCLK信号的上升沿。虽然温保持有效,数据
被不断地写入到每个循环的FIFO中。输出
端口由一个自由运行读取控制以类似的方式
时钟( RCLK )和读使能引脚( REN) 。此外,该
CY7C42X5有一个输出使能引脚( OE ) 。读取和
写时钟可连接在一起的单时钟操作或
两个时钟可以独立地为异步运行
读/写的应用程序。时钟频率高达100 MHz的
可以实现的。
重传和同步殆满/殆空标志
功能都可以在这些设备上。
深度扩展,可以使用级联输入( WXI ,
RXI ) ,级联输出( WXO , RXO ) ,并首先加载( FL )引脚。
该WXO和RXO引脚连接到所述WXI和RXI
下一个器件的引脚,而最后的WXO和RXO销
设备应当连接到的所述WXI和RXI销
第一个设备。所述第一设备的FL引脚连接到V
SS
所有剩余的设备FL引脚应连接到V
CC
.
该CY7C42X5提供五种状态引脚。这些引脚是否变形
编码来确定的五种状态之一:空,几乎是空白,
半满,几乎完全和完全(见
表2)。
半满标志
股WXO引脚。该标志是在独立和有效
宽度扩展配置。在深度扩大,这
引脚提供了扩展( WXO )信息用于
信号的下一个FIFO中时,它就会被激活。
空和满的标志是同步的,也就是说,它们改变
相对于任一读时钟( RCLK )或写时钟状态
( WCLK ) 。当进入或离开空的状态中,标志是
完全由RCLK更新。该标志表示全州
由WCLK专门更新。同步标志架构设计师用手工
tecture保证标志仍然有效从一个
时钟周期到下一个。正如前面提到的,概
空/几乎满标志成为同步,如果
V
CC
/ SMODE被连接到V
SS
。所有的配置都制作
采用了先进的0.65μ n阱CMOS技术。输入
ESD保护大于2001V ,和闩锁是防止─
通过使用保护环的对外债务。
功能说明
T
他CY7C42X5是高速,低功耗,先入先出
(FIFO )存储器与时钟频率的读写接口。所有
18位宽,且引脚/功能兼容
IDT722x5 。该CY7C42X5可以级联,以增加FIFO
深度。可编程特性包括殆满/殆
空标志。这些FIFO提供了各种各样的解决方案
的数据缓冲的需要,包括高速数据采集,
多处理器接口和通信缓冲。
这些FIFO具有18位输入和输出端口是CON-
由独立的时钟受控和使能信号。输入端口是
赛普拉斯半导体公司
3901北一街
圣荷西
CA 95134 •
408-943-2600
1995年4月 - 修订1997年8月18日