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CY7C1329-100AC 参数 Datasheet PDF下载

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型号: CY7C1329-100AC
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内容描述: 64K ×32的同步流水线高速缓存RAM [64K x 32 Synchronous-Pipelined Cache RAM]
分类和应用: 存储内存集成电路静态存储器时钟
文件页数/大小: 15 页 / 353 K
品牌: CYPRESS [ CYPRESS SEMICONDUCTOR ]
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CY7C1329
64K ×32的同步流水线高速缓存RAM
特点
•支持133 -MHz的总线的奔腾
和PowerPC
零等待状态操作
•完全注册的输入和输出管线
手术
• 64K ×32个通用I / O架构
•单3.3V电源
•快速时钟到输出时间
- 4.2纳秒( 133 - MHz器件)
- 5.5纳秒( 100 - MHz器件)
•用户可选的突发计数器支持Intel
®
奔腾交错或线性突发序列
•独立的处理器和控制器地址选通
•同步自定时写
•异步输出使能
• JEDEC标准的100引脚TQFP封装的引脚
• “ZZ”睡眠模式选项和停止时钟选项
所有同步输入通过输入寄存器控制
通过在时钟的上升沿。所有数据输出通过
输出寄存器的时钟的上升沿来控制。
从时钟的上升最高接入时延是4.2纳秒( 133 - MHz的
装置) 。
该CY7C1329支持或者交错突发
序所使用的Intel Pentium处理器或线性猝发
序所使用的处理器,如PowerPC的。该
脉冲串序列是通过MODE引脚选择。访问
可以断言无论是处理器的地址启动
频闪( ADSP )或控制器地址选通( ADSC )在
时钟的上升。通过突发序列晋升地址
由ADV输入控制。 2位片上环绕
突发计数器捕获所述第一地址中的脉冲串序列
并自动递增地址的休息
突发存取。
字节写操作均合格的四个字节写入
选择( BW
[3:0]
)输入。全局写使能( GW )覆盖
所有写字节输入和写入数据到所有的四个字节。所有的写操作
带有片上同步自定时写的进行
电路。
三个同步片选( CE
1
,CE
2
,CE
3
)和一个
异步输出使能( OE )为方便银行
选择和输出三态控制。为了提供
在深度扩展正确的数据, OE是在掩盖
从取消选择新兴的读周期的第一个时钟时,
状态。
功能说明
该CY7C1329是3.3V , 64K 32同步流水线
SRAM缓存设计,支持零等待状态的二次
高速缓存以最小的胶合逻辑。
逻辑框图
CLK
ADV
ADSC
ADSP
A
[15:0]
GW
BWE
BW
3
BW
2
BW
1
模式
(A
[1:0]
) 2
BURST Q
0
CE计数器
Q
1
CLR
地址
CE注册
D
D
Q
14
16
16
14
DQ [31:24 ]问
BYTEWRITE
注册
64K × 32
内存
ARRAY
ð DQ [23:16 ]问
BYTEWRITE
注册
D
D
Q
DQ [15:8 ]
BYTEWRITE
注册
Q
DQ [7:0 ]
BYTEWRITE
注册
BW
0
CE
1
CE
2
CE
3
32
32
D
ENABLE Q
CE注册
CLK
D
Q
使能延迟
注册
CLK
产量
注册
CLK
输入
注册
CLK
OE
ZZ
睡觉
控制
DQ
[31:0]
赛普拉斯半导体公司
文件编号: 38-05279牧师* B
3901北一街
圣荷西
,
CA 95134
408-943-2600
修订后的2004年3月31日