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CY7C037V-15AC 参数 Datasheet PDF下载

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型号: CY7C037V-15AC
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内容描述: 3.3V 32K / 64K X 16/18双端口静态RAM [3.3V 32K/64K x 16/18 Dual-Port Static RAM]
分类和应用: 存储内存集成电路静态存储器
文件页数/大小: 18 页 / 237 K
品牌: CYPRESS [ CYPRESS SEMICONDUCTOR ]
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CY7C027V/028V
CY7C037V/038V
引脚德网络nitions
左侧端口
CE
0L
,CE
1L
读/写
L
OE
L
A
0L
–A
15L
I / O
0L
-I / O
17L
SEM
L
UB
L
LB
L
INT
L
L
M / S
V
CC
GND
NC
读/写
R
OE
R
A
0R
–A
15R
I / O
0R
-I / O
17R
SEM
R
UB
R
LB
R
INT
R
R
正确的端口
CE
0R
,CE
1R
读/写使能
OUTPUT ENABLE
地址(A
0
–A
14
为32K ;一
0
–A
15
对于64K器件)
数据总线输入/输出( I / O
0
-I / O
15
对于x16设备; I / O
0
-I / O
17
对于X18 )
信号灯启用
高字节选择( I / O
8
-I / O
15
对于x16设备; I / O
9
-I / O
17
对于X18设备)
低字节选择( I / O
0
-I / O
7
对于x16设备; I / O
0
-I / O
8
对于X18设备)
中断标志
忙标志
主机或从机选择
动力
无连接
共享锁。只有一侧可控制锁存器(信号)在
任何时间。信号量的控制指示的共享资源是
在使用中。自动断电功能独立控制
每个端口由一个片选( CE)引脚。
该CY7C027V / 028V及CY7037V / 038V都可以
100引脚薄型四方扁平封装塑料( TQFP ) 。
写操作
数据必须被设置为T的时间
SD
上升沿之前
读/写的,以保证有效的写入。写操作所配置
不论是由R / W引脚受控(见写周期第1波)或
CE引脚(见写周期第2波) 。所需投入
非争用的操作概括在
表1中。
如果一个位置被一个端口,另一写入
试图读取该位置端口,一个端口到端口的流出液
延迟必须发生之前的数据被读出到输出;其它 -
聪明的数据读取不确定性。数据将是有效的
油口T
DDD
后的数据被呈现在其他端口上。
读操作
当读取装置,用户必须断言二者在OE
和CE引脚。数据将用T
ACE
CE或T后
美国能源部
之后, OE是
断言。如果用户希望访问一个信号量标志,则
扫描电镜脚必须断言,而不是CE引脚,和OE还必须
被认定。
中断
上面的两个存储单元可以用于讯息
路过。最高的存储器位置( 7FFF为
CY7C027V / 37V , FFFF为CY7C028V / 38V )是邮箱
为正确的端口和第二高的存储器位置
( 7FFE的CY7C027V / 37V , FFFE为CY7C028V / 38V )
是邮箱为左端口。当一个端口写入到
其他端口的邮箱,会产生一个中断给业主。
中断复位时,主人读取的内容
邮箱。该消息是用户定义的。
每个端口可以读取其他端口的邮箱无需重新设定
该中断。忙碌信号的有效状态(一个端口)
阻止端口中断设置为获胜端口。
描述
芯片使能( CE为低电平时, CE
0
V
IL
和CE
1
V
IH
)
架构
该CY7C027V / 028V和CY7037V / 038V组成的阵列的
16为32K和64K字和18比特的每一个双端口RAM
单元,I / O和地址线和控制信号(CE, OE , R / W) 。
这些控制引脚允许独立访问读取或写入
在内存中的任何位置。为了处理同时写入/读取到
相同的位置,繁忙的引脚提供的每个端口上。两个中断
( INT)的引脚可以用于端口到端口的通信。两个sema-
phore (SEM)的控制引脚用于分配共享资源。
通过M / S引脚,这些器件可以作为主站(BUSY引脚
为输出),或者作为一个奴隶( BUSY引脚输入) 。同时该系列器件
必须通过CE控制的自动断电功能。每个端口
设置有其自己的输出使能控制(OE ),它允许数据
可以从设备中读取。
功能说明
该CY7C027V / 028V及CY7037V / 038V低功耗
CMOS 32K , 64K X 16/18双口静态RAM 。各种arbi-
tration方案包含在设备处理situa-
当多个处理器访问同一块数据的系统蒸发散。
提供两个端口,允许独立, asynchro-
理性的访问读取和写入到任意位置的内存。
该装置可被用作独立的十八分之十六位双端口
静态RAM或多个设备可以顺序组合,以
函数作为三十六分之三十二位或者更宽的主/从双端口静态
内存。在M / S引脚提供了一种用于执行三十六分之三十二位或
而不需要单独的mas-更宽的存储器的应用程序
器设备和从设备或额外的分立逻辑。应用
领域包括处理器间/多处理器设计, commu-
通信业的地位缓冲和双端口视频/图形MEM-
ORY 。
每个端口都有独立的控制引脚:芯片使能( CE ) ,
读或写使能( R / W) ,并输出使能(OE ) 。两个标志
提供每个端口( BUSY和INT )上。 BUSY信号的端口
试图访问当前正在被访问的同一位置
其他端口。中断标志位( INT )允许之间的通信
由一个邮件箱的装置的端口或系统。该信号灯使用
传递一个标志,或令牌,从一个端口到另一个时,表示一个
共享资源在使用中。旗语逻辑由八个
文件编号: 38-06078修订版**
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