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CY23S05SC-1H 参数 Datasheet PDF下载

CY23S05SC-1H图片预览
型号: CY23S05SC-1H
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内容描述: 低成本3.3V传播感知™零延迟缓冲器 [Low-Cost 3.3V Spread Aware⑩ Zero Delay Buffer]
分类和应用: 时钟驱动器逻辑集成电路光电二极管
文件页数/大小: 9 页 / 174 K
品牌: CYPRESS [ CYPRESS SEMICONDUCTOR ]
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05
CY23S09
CY23S05
低成本3.3V传播感知™零延迟缓冲器
特点
•10 MHz至100- / 133 - MHz的工作范围,兼容
与CPU和PCI总线频率
•零输入输出传输延迟
•多低偏移输出
- 输出 - 输出偏斜小于250 ps的
- 设备 - 设备偏斜小于700 ps的
- 一个输入驱动五个输出( CY23S05 )
- 一个输入驱动器9输出,归纳为4 + 4 + 1
(CY23S09)
•小于200 ps的周期到周期抖动兼容
奔腾
基于系统
•测试模式绕过PLL( CY23S09只,请参阅选择
第2页上输入解码表)
•提供节省空间的16引脚, 150密耳SOIC , 4.4毫米
TSSOP封装,以及150万SSOP ( CY23S09 )或8引脚, 150万
SOIC封装( CY23S05 )
• 3.3V工作电压,先进的0.65μ CMOS技术
•传播感知™
高达100- / 133 - MHz的频率,并具有传动比更高
-1装置。所有部件具有片上的PLL该锁定到输入
REF引脚的时钟。 PLL反馈是在芯片上,并
从CLKOUT垫获得。
该CY23S09有四个输出两个银行各,它可以
如图所示,选择输入的选择输入被控制
第2页的解码表。如果所有的输出时钟是不必需的,
B银行可以三态。选择输入还允许
输入时钟被直接施加到所述输出端对芯片和
系统测试目的。
该CY23S09和CY23S05的PLL进入掉电模式
当有对REF输入没有上升沿。在这种状态下,
的输出三态并且PLL被关断,从而导致
在小于12.0
µA
电流消耗(商业temper-的
ATURE设备)和25.0
µA
(工业温度
设备)。该CY23S09 PLL的一个额外关闭
情况下,如示于下表中。
多CY23S09和CY23S05设备可以接受相同
输入时钟和分发。在这种情况下,之间的歪斜
的两个设备输出被保证是小于700 ps的。
所有输出都小于200 ps的周期到周期抖动。该
输入到输出的传播延迟在两个设备上是
保证是小于350 ps的,并且输出到输出
歪斜保证是小于250 ps的。
该CY23S05 / CY23S09是两种不同的组态提供
口粮,如第6页上显示的订购信息
CY23S05-1 / CY23S09-1是基部。该CY23S05-1H /
CY23S09-1H是-1的高驱动版本,它的崛起
和下降时间比-1快得多。
功能说明
该CY23S09是设计成一种低成本3.3V零延迟缓冲器
分配高速时钟,并采用16引脚SOIC
封装。该CY23S05是的八脚版
CY23S09 。它接受一个参考输入,并驱动了5
低偏移时钟。每个器件的-1H版本在操作
框图
PLL
REF
MUX
CLKOUT
CLKA1
CLKA2
CLKA3
CLKA4
CLKB1
选择输入
解码
S1
CLKB2
CLKB3
引脚配置
SOIC / TSSOP / SSOP
顶视图
REF
CLKA1
CLKA2
V
DD
GND
CLKB1
CLKB2
S2
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
CLKOUT
CLKA4
CLKA3
V
DD
GND
CLKB4
CLKB3
S1
S2
CY23S09
CLKB4
CY23S09
REF
PLL
CLKOUT
CLK1
CLK2
CLK3
CLK4
SOIC
顶视图
REF
CLK2
CLK1
GND
1
2
3
4
8
7
6
5
CLKOUT
CLK4
V
DD
CLK3
CY23S05
CY23S05
赛普拉斯半导体公司
文件编号: 38-07296牧师* B
3901北一街
圣荷西
CA 95134 • 408-943-2600
修订后的2002年12月22日