SPT9687SIC 参数 Datasheet PDF下载

型号：	SPT9687SIC
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内容描述：	双超快型电压比较器 [DUAL ULTRAFAST VOLTAGE COMPARATOR]
分类和应用：	比较器
文件页数/大小：	8 页 / 196 K
品牌：	CADEKA [ CADEKA MICROCIRCUITS LLC. ]

切换条款（参见图1 ）

PDH

输入到输出的延迟高 - 传播

延迟从时刻的输入信号来测量

跨过参考电压（ ±输入偏移

电压）到50％点的输出低到高

过渡。

输入到输出的低时延 - 传播

延迟从时间测得的输入信号的杂交

参考电压（ ±输入失调电压）到

50 ％点的输出高电平变为低电平过渡。

一般信息

该SPT9687是一种超高速双电压compara-

器。它提供了严密的绝对特色。该装置具有

差分模拟输入和互补输出的逻辑

用ECL系统兼容。输出级是足够

用于驱动端的50欧姆传输线。

该SPT9687有一个互补的锁存使能控制。

每个比较器。双方应通过标准ECL逻辑驱动

的水平。

双比较器共享相同的V

和V

连接

系统蒸发散而为每个比较器，以分离的理由

实现高串扰抑制。

图2 - 内部功能框图

PDL

PLOH

锁存使能输出高延时 - 中

从50％点测得的传播延迟

锁存使能信号低电平变为高电平转换到

50 ％点的输出低到高的过渡。

电压OVERDRIVE - 之间的区别

差分输入和基准电压。

PLOL

锁存使能到输出低延时 - 中

从50％点测得的传播延迟

锁存使能信号低电平到高电平转换到

50 ％点的输出高电平变为低电平过渡。

最小保持时间 - 之后的最短时间

该锁存器的负跳变使能信号，该

输入信号必须以可保持不变

获得并在输出端保持。

LATCH最小使能脉冲宽度 -

该锁存使能信号必须最短时间

高，以获得输入信号的变化。

最小建立时间 - 之前的最短时间

该锁存器的负跳变使能信号，即

输入信号的变化，必须存在，以便

获得并在输出端保持。

PRE

AMP

LATCH

ECL

OUT

REF

CLK

BUF

GND1

GND2

典型接口电路

使用比较器的典型接口电路示

图3.虽然它需要很少的外部元件

和易于应用，有几个条件

应得到满足，以达到最佳性能。很

比较高的操作速度需要仔细

布局，供应脱钩，和反式设计恰当

任务线。

由于SPT9687比较器是一个非常高的频率和

高增益器件，某些布局规则必须遵循

避免虚假振荡。比较应该是溶胶

dered到板元件引线的长度越短

成为可能。一个接地层应使用，并且输入

阻抗的部分应保持尽可能低，以

减小寄生反馈。如果输出电路板走线

大于大约二分之一英寸长，微带技

niques必须采用以防止阻尼振荡的输出

波形。而且，微带线，必须在被终止

远端与线的特性阻抗

防止反射。所有的电源电压引脚应被去

加上高频电容尽可能靠近

装置成为可能。所有的地面和N / C引脚应

连接到同一个接地平面，以进一步提高噪声

免疫和屏蔽。如果使用SPT9687作为单一

比较器，该比较器不活动的输出可以是

接地，开路或终止50欧姆至-2 V.所有

在活动比较器的输出，无论是使用或不使用，

应具有相同的终端，以尽量减少地面电流

租开关瞬变。

注：为了保证设备的正常供电时，输入

应保持在+ 1.5V时开机。

SPT9687

3/21/97

时序信息

对于比较器的时序图示于图1中。

锁存使能（ LE）的脉冲被显示在顶部。如果乐高

和LE低的SPT9687 ，比较器跟踪

输入差分电压。当LE为低电平和LE

高，比较器的输出被锁存到他们现有的

逻辑状态。

输入信号的前沿（它由一个

50 mV的过驱动电压）的变化，比较器输出

吨的时间后

PDL

或T

PDH

（Q或Q）。输入信号必须

保持时间t

（设定时间）在LE下降沿之前

边缘和LE上升沿，保持时间t

在下跌后

边的比较器来接受数据。吨后

时，输出

忽略该输入状态，直到闩锁再次被选通。一

吨的最小锁存脉冲宽度

是必要的选通

的时间后动作，且输出转换发生

PLOH

或T

PLOL

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