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CDK1306 参数 Datasheet PDF下载

CDK1306图片预览
型号: CDK1306
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内容描述: 10位, 40 MSPS 160MW A / D转换器 [10-bit, 40 MSPS 160mW A/D Converter]
分类和应用: 转换器
文件页数/大小: 11 页 / 1296 K
品牌: CADEKA [ CADEKA MICROCIRCUITS LLC. ]
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数据表
典型接口电路
极少的外部元件即可实现
规定的设备的性能。图3示出了典型
当在正常使用CDK1306接口要求
电路的操作。以下各节提供
主要功能和关键大纲的说明
性能标准要考虑实现最优
器件的性能。
n
由于只有16个比较时,一个巨大的动力
节约得以实现。
使用闭环进行自动调零操作
系统中使用的比较器的多个样本
响应于参考零。
n
CDK1306
10位, 40 MSPS 160MW A / D转换器
n
自动校准操作,这校准增益
该MSB参考和LSB参考,也做
用一个闭环系统。增益的多个样本
错误被集成以产生校准电压为
每个ADC部分。
电容的位移电流,从而可诱发
采样误差,因为只有一个比较器被最小化
样品在时钟周期期间的输入。
电源和接地
CADEKA表明,无论是数字和模拟电源
在CDK1306电压,电流从一个单一的模拟而得
供给如图3,独立的数字电源
应该被用于所有的接口电路。 CADEKA建议
使用这种电源配置,以防止一个可能
在上电sible闭锁状态。
n
n
总的输入电容是非常低的,因为各款
未对信号进行采样的转换器是分离的
从输入由传输门。
操作说明
总体结构的CMOS ADC被显示在
框图。该设计包含16个连续相同
逼近型ADC部分,所有并行操作,一个16
相时钟发生器,一个11位的16:1的数字输出多
路器,校正逻辑,和一个参考电压发生器
提供共同的参考电平为每个ADC部分。
高采样率是通过使用多个特区实现
ADC的部分并联,每个采样输入的
信号顺序。每个ADC采用16个时钟周期
完成转换。的时钟周期被分配为
如表2所示。
表2.时钟周期
时钟
1
2
3
4
5-15
16
手术
参考零取样
自动调零比较
自动校准比较
输入采样
11位SAR转换
数据传输
参考电压
该CDK1306需要使用一个外部电压的
驱动参考偏高的年龄参考
阶梯。它必须是3V至5V的范围内。低
梯子的一侧通常是连接到AGND ( 0.0V ) ,但
可以运行到2.0V与第二参考。模拟
输入电压范围内将跟踪的总电压差异
阶梯感的线条, V之间测量
RHS
和V
RLS
.
提供力量和意识水龙头,以确保准确
上下梯子感测线的稳定的设置
电压横跨部件到部件和温度变化。
通过使用图4所示的结构中,偏移量和
小于± 2的增益误差的LSB可制得。
在情况下,在更广泛的变化偏移和增益
容忍,V
REF
可以直接连接到V
RHF
和AGND
可以直接连接到V
RLF
如示于图5解耦
力感线至AGND与0.01μF电容
(芯片帽优选的),以最小化的高频噪声
注入。
如果使用该简化的结构中,遵从以下
siderations应考虑在内。参考
在图5中所示梯形电路是一个简化的代表性
化实际参考梯子与力感
如图水龙头。由于在实际的内部结构
梯子,从V的电压降
RHF
到V
RHS
不等价
借由V的电压降
RLF
到V
RLS
.
冯1A
的16相时钟,它是从输入的时钟信号,
同步这些事件。对于相邻的定时信号
ADC的部分通过一个时钟周期移位,使得所述AN-
考勤输入被采样的输入时钟的由每个周期
只有一个ADC部分。经过16个时钟周期,在时序
荷兰国际集团周期重复。从模拟输入采样的延迟
成相应的数字输出是12个时钟周期。
© 2008 CADEKA微电路有限责任公司
www.cadeka.com
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