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    CDK8307CILP64 参数 Datasheet PDF下载

    CDK8307CILP64图片预览
    型号： CDK8307CILP64
    PDF下载： 下载PDF文件 查看货源
    内容描述： 12月13日位，四十零分之二十零/ 50/ 65 / 80MSPS ，八通道，超低功耗ADC LVDS [12/13-bit, 20/40/50/65/80MSPS, Eight Channel, Ultra Low Power ADC with LVDS]
    分类和应用：
    文件页数/大小： 31 页 / 1408 K
    品牌： CADEKA [ CADEKA MICROCIRCUITS LLC. ]
     浏览型号CDK8307CILP64的Datasheet PDF文件第4页浏览型号CDK8307CILP64的Datasheet PDF文件第5页浏览型号CDK8307CILP64的Datasheet PDF文件第6页浏览型号CDK8307CILP64的Datasheet PDF文件第7页浏览型号CDK8307CILP64的Datasheet PDF文件第9页浏览型号CDK8307CILP64的Datasheet PDF文件第10页浏览型号CDK8307CILP64的Datasheet PDF文件第11页浏览型号CDK8307CILP64的Datasheet PDF文件第12页  
    Data Sheet
    Pin Assignments - TQFP
    (Continued)
    Pin No.
    41
    42
    45
    61
    62, 64, 66, 67, 69
    65
    71
    72
    75
    76
    77
    78
    Pin Name
    FCLKP
    FCLKN
    RESETN
    TP
    NC
    VCM
    CLKP
    CLKN
    OVDD
    CSN
    SDATA
    SCLK
    Description
    LVDS frame clock (1x), positive output
    LVDS frame clock (1x), negative output
    Reset SPI interface
    Test pin. Leave open (un-connected) or connect to GND.
    Not connected
    Common mode output pin, 0.5 AVDD
    Positive differential input clock
    Negative differential input clock.
    Digital CMOS inputs supply voltage (1.7V to 3.6V)
    Chip select enable. Active low.
    Serial data input
    Serial clock input
    CDK8307
    12/13-bit, 20/40/50/65/80MSPS, Eight Channel, Ultra Low Power ADC with LVDS
    Rev 1A
    ©2009 CADEKA Microcircuits LLC
    www.cadeka.com
    8

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