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5962-9052701MXA 参数 Datasheet PDF下载

5962-9052701MXA图片预览
型号: 5962-9052701MXA
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内容描述: TAXIchip集成电路(透明异步Xmitter ,接收器接口) [TAXIchip Integrated Circuits(Transparent Asynchronous Xmitter-Receiver Interface)]
分类和应用: 驱动器接口集成电路
文件页数/大小: 127 页 / 704 K
品牌: AMD [ AMD ]
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AMD  
Am7969-175 TAXIchip Receiver (Notes 13, 14, 22)  
Parameter  
No.  
Symbol  
Parameter Description  
Test Conditions  
Min  
Max  
Unit  
Bus Interface Signals: DO0–DO7, DO8/CO3, DO9/CO2, CO0–CO1, DSTRB, CSTRB, IGM, CLK, CNB, VLTN  
35  
36  
tP  
CLK Period (Note 24)  
5.7 n  
8 n  
ns  
ns  
2t35  
n
tPD  
Data Valid to STRBDelay  
TTL Output Load  
TTL Output Load  
TTL Output Load  
TTL Output Load  
TTL Output Load  
TTL Output Load  
TTL Output Load  
TTL Output Load  
TTL Output Load  
–2  
2t35  
n
37  
38  
tPD  
tPD  
tPD  
tPD  
tPW  
tPW  
tPW  
tPD  
tS  
CLKto STRB↑  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
ns  
+15  
t35  
n
CLKto STRB↓  
–5  
3t35  
n
38a  
39  
STRBto CLK(Note 23)  
CLKto Data Valid Delay  
STRB Pulse Width HIGH  
CLK Pulse Width HIGH  
CLK Pulse Width LOW  
SERIN to CLKDelay  
–10  
t35  
n
-
+
23  
5t35  
2n  
5t35  
n
40  
5t35  
n
41  
–7  
–4  
5t35  
n
42  
t35  
2n  
2t35  
n
43  
+17  
–31  
+26  
t35  
n
47A  
CNBto CLKSetup Time  
(Note 19)  
-
47B  
48  
tS  
tH  
CNBto CLKSetup Time  
CNBto CLKHold  
29  
ns  
ns  
2t35  
n
–3  
2t35  
n
49  
tPW  
CNB Pulse Width LOW  
ns  
ns  
Serial Interface Signals: SERIN+, SERIN–  
57  
tJ  
SERIN± Peak to Peak Input Jitter  
2
Tolerance (Note 16)  
Miscellaneous Signals: X1 (Note 15)  
60  
61  
tPW  
tPW  
X1 Pulse Width HIGH  
X1 Pulse Width LOW  
21  
21  
ns  
ns  
31  
Am7968/Am7969-175  
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