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    EP1SGX40GF1020I6N 参数 Datasheet PDF下载

    EP1SGX40GF1020I6N图片预览
    型号： EP1SGX40GF1020I6N
    PDF下载： 下载PDF文件 查看货源
    内容描述： [Field Programmable Gate Array, 4697 CLBs, 41250-Cell, CMOS, PBGA1020, 33 X 33 MM, 1 MM PITCH, LEAD FREE, FBGA-1020]
    分类和应用： 栅可编程逻辑
    文件页数/大小： 279 页 / 3682 K
    品牌： ALTERA [ ALTERA CORPORATION ]
     浏览型号EP1SGX40GF1020I6N的Datasheet PDF文件第123页浏览型号EP1SGX40GF1020I6N的Datasheet PDF文件第124页浏览型号EP1SGX40GF1020I6N的Datasheet PDF文件第125页浏览型号EP1SGX40GF1020I6N的Datasheet PDF文件第126页浏览型号EP1SGX40GF1020I6N的Datasheet PDF文件第128页浏览型号EP1SGX40GF1020I6N的Datasheet PDF文件第129页浏览型号EP1SGX40GF1020I6N的Datasheet PDF文件第130页浏览型号EP1SGX40GF1020I6N的Datasheet PDF文件第131页  
    Stratix GX Architecture  
    Figure 4–35. 36 × 36 Multiply Mode  
    signa (1)  
    signb (1)  
    aclr  
    clock  
    ena  
    A[17..0]  
    B[17..0]  
    D
    Q
    Q
    ENA  
    D
    Q
    ENA  
    CLRN  
    CLRN  
    D
    ENA  
    CLRN  
    A[35..18]  
    B[35..18]  
    D
    Q
    Q
    Data Out  
    D
    Q
    ENA  
    D
    Q
    ENA  
    ENA  
    36 × 36  
    Multiplier  
    Adder  
    CLRN  
    CLRN  
    CLRN  
    D
    signa (2)  
    signb (2)  
    ENA  
    CLRN  
    A[35..18]  
    B[17..0]  
    D
    Q
    Q
    ENA  
    D
    Q
    ENA  
    CLRN  
    CLRN  
    D
    ENA  
    CLRN  
    A[17..0]  
    D
    Q
    Q
    ENA  
    D
    Q
    ENA  
    CLRN  
    CLRN  
    B[35..18]  
    D
    ENA  
    CLRN  
    Notes to Figure 4–35:  
    (1) These signals are not registered or registered once to match the pipeline.  
    (2) These signals are not registered, registered once, or registered twice for latency to match the pipeline.  
    Altera Corporation  
    February 2005  
    4–61  
    Stratix GX Device Handbook, Volume 1  

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