ACT 5261
64位超标量微处理器
特点
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全军事化QED RM5261微处理器
双发射超标量微处理器 - 可以发出1
每个周期的整数和一个浮点指令
150 ， 200 ， 250 MHz的工作频率 - 联系工厂
对于最新的速度
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345的Dhrystone MIPS 2.1
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SPECInt95 7.3 ， SPECfp95 8.3
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133,
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高性能浮点单元：高达500 MFLOPS
循环重复率常见的单精度运算
有的双精度运算
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两个周期重复率双精度乘法和双
精度合并乘加运算
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单周期重复率的单精度乘法结合
添加操作
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单身
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引脚排列与流行的RM5260兼容
高性能系统接口与RM5260兼容，
RM 5270 ， RM5271 ， RM7000 ， R4600 ， R4700和R5000
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64-bit
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• MIPS IV指令集
点乘加指令在提高性能
信号处理和图形应用
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有条件的举措来减少分支频率
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索引寻址模式（寄存器+寄存器）
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漂浮的
复用系统地址/最佳价格数据总线/
性能
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高性能写协议未缓存的最大写入
带宽
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支持1/2时钟除数（2， 2.5 ，3， 3.5 ，4， 4.5 ，5，6 ，7，8 ，9）
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IEEE 1149.1 JTAG边界扫描
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嵌入式应用增强功能
DSP整数乘法累加指令和3
操作数乘法指令
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I和D高速缓存锁定了一套
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对于中断可选专用的异常向量
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专
•集成的片上高速缓存
指令 - 2路组相联
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32KB数据 - 2路组相联
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事实上，索引，物理标记
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回写式和直写在每页的基础
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第一次双数据高速缓存未命中的管道重新启动
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32KB
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全静态CMOS设计，具有掉电逻辑
与WAIT指令降低功耗模式
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3.6瓦的典型功率的200MHz @
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2.5V内核， 3.3V IO的
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待机
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208引脚CQFP ，腔式封装（ F17 ）
208引脚CQFP ，倒足迹（ F24 ） ，意在复制
商业QED足迹
179针PGA封装（未来
产品）
(P10)
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•集成的存储器管理单元
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十分
联想联合TLB （由I和D的翻译共享）
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48双项映射96页
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可变页面大小（ 4KB到16MB的4倍递增）
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框图
初步
eroflex电路技术 - RISC TurboEngines对于未来© SCD5261 REV 1 98年12月22日
AEROFLEX [ AEROFLEX CIRCUIT TECHNOLOGY ]
