AD8561
应用
优化高速性能
正如任何高速比较器或放大器，适当的设计
和布局的技术应被用来确保最佳perfor-
曼斯从AD8561 。高速的性能极限
电路可以很容易地杂散电容的结果，不正确的
接地阻抗或其它布局问题。
最小阻力从源到输入是一个重要的
考虑最大化的高速运转
AD8561 。与等效组合源电阻
输入电容可能会导致在输入一个滞后的反应，
从而延缓输出。 ，AD8561的输入电容
在从一个输入引脚的寄生电容，以组合
地会导致等效电容的几个皮法
距离。 3 kΩ的源电阻和5的组合pF的
输入电容产生一个时间常数为15毫微秒，这是
比，AD8561的5纳秒能力慢。源阻抗
元代应小于1kΩ的最佳性能。
同样重要的是要为电源提供旁路电容
供应在高速应用。 A 1
μF
电解旁路
电容应放置0.5英寸范围内的每个功率
电源引脚，引脚1和引脚4接地。这些电容将
减小来自电源的任何潜在的电压纹波。在
此外，一个10 nF陶瓷电容应尽可能靠近
可能从电源引脚接地。这些电容器
作为高频率中的电荷储存器的设备
切换。
地平面，建议进行适当的高速perfor-
曼斯。这可以通过使用一个连续的导电创建
平面上的电路板的表面上，只允许游
在对必要的电流路径的平面。接地平面
提供低电感接地，从而消除了任何潜在的昼夜温差
整个电路板ferences在不同地点
从造成“地反弹。 ”一个适当的接地平面也
最大程度地减少在电路板寄生电容的影响。
更换的LT1016
例如：一个比较快速移动的信号比作
固定的2.5 V基准电压源。由于比较只需要能操作
吃了当信号接近2.5V，两个信号将内
输入范围（近2.5 V和3.0下以及V ）时的COM
parator需要改变输出。
注意，信号远远大于3.0V，将导致增加的
输入电流，并且可以使设备更慢运行。
在AD8561的输入偏置电流低（ -3
μA
典型）
比LT1016 （ +5
μA
典型的），并且电流流出的
在AD8561和成LT1016 。如果相对低阻值的电阻
和/或低阻抗源上的输入端使用时，电压
年龄移由于偏置电流应该是小的。
在AD8561 （ 6.75纳秒典型值）比LT1016快（ 10纳秒
典型值） 。虽然这是对许多系统有益，定时可
需要进行调整，以更高的速度的优点。
该AD8561有稍微的输出电压摆幅，从0.2 V
上述地面内1.1V的正电源电压的。
在AD8561采用更小的电流（一般为5 mA）的比LT1016
（通常为25 mA）的。
增加输出摆幅
虽然不是必需的正常操作时，输出电压
在AD8561的摆动能够增加通过连接5千欧
电阻器从所述装置的至V +电源的输出。
该结构可以在低电压电源有用
应用中最大限度地提高输出电压摆幅一点很
坦。添加5 kΩ的上拉电阻，该器件的输出会
不，AD8561的规格有不利影响。
输出负载的注意事项
AD8561的输出能够提供高达40 mA的输出电流
无传播延迟的任何显著增加。该
该装置的输出不应该被连接到多个
20 （20）， TTL输入逻辑门，或驱动器的负载电阻
小于100
Ω.
为了确保从AD8561的最佳性能，一点很
坦，以尽量减少设备的输出的电容性负载。
容性负载大于50 pF的会引起振铃的
输出波形，并将降低的工作带宽
比较器。
建立和保持时间用于锁存
产量
该AD8561是引脚与LT1016比较器兼容。
而很容易具有较高perfor-替换LT1016
曼斯AD8561 ，请注意，有差异，它是
用于检查这些以确保正常运行。
还有的AD8561之间的五大差异
LT1016输入电压范围，输入偏置电流，转速，输出
放摆动和功率消耗。
当在+5 V单电源供电时， LT1016具有一个
输入电压范围从1.25 V至3.5 V的AD8561具有
上述3.0 V较宽的输入电压范围为0 V至3.0 V.信号可能
导致较慢的响应时间（参见图8） 。如果两个信号
超过3.0V时，信号可以被移动或衰减，使
他们进入的范围，同时要注意对源电阻的说明
tance在优化的高速性能。如果只有一个的
信号超过3.0V，仅稍微，另一个信号是始终
完全在0 V 〜3 V的范围内，比较器可以操作
无需改动电路。
锁存器的输入，引脚5 ，可用于保留数据在输出
的AD8561 。当在闩锁输入端的电压变为高电平时，
该装置的输出将保持恒定而不管
输入电压。在设置时间的锁存器是2 ns-3的纳秒和
保持时间为3毫微秒。这意味着，为了保证数据保持在
的输出，输入信号必须是之前有效至少5纳秒
闩锁销变高，且必须保持有效后至少3纳秒
闩锁引脚变为高电平。一旦锁存输入电压变低，
新的输出数据将出现在大约8纳秒。
逻辑高电平的锁存输入为最小的2.0 V和一
逻辑低是一个最大的0.8 V.这使得闩锁输入
与TTL或CMOS逻辑门轻松连接。闩锁
电路中的AD8561有没有内置的滞后。
REV 。一
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