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AD73360LAR 参数 Datasheet PDF下载

AD73360LAR图片预览
型号: AD73360LAR
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内容描述: 六路输入通道模拟前端 [Six-Input Channel Analog Front End]
分类和应用:
文件页数/大小: 32 页 / 283 K
品牌: AD [ ANALOG DEVICES ]
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AD73360L
参考电压
该AD73360L参考, REFCAP ,是一个带隙基准
它提供了一个低噪声,温度补偿的参考
到ADC。参考的缓冲版本也由
可在REFOUT引脚和可用于偏压其他
外部模拟电路。引用有一个默认的名义
1.2 V.价值
参考输出( REFOUT )可被允许用于偏压
外部电路通过设置RU位( CRC : 6)结直肠癌。
串行端口( SPORT )
注:由于每个AD73360L有自己的体育节中,
在所有体育寄存器的设置进行编程。该寄存器
控制SPORT和采样率运行TER值( CRA和
CRB)必须具有相同的值进行编程,否则
可能会出现不正确的操作。
在程序模式( CRA : 0 = 0 )时,器件的内部的配置
化可以通过写八个内部控制进行编程
寄存器。在这种模式下,控制信息可以被写入到或
从AD73360L读取。在数据模式( CRA : 0 = 1 ) , Infor公司的任何
发送到所述设备息将被忽略,而编码器
节器(ADC)的数据从设备中读取。在这种模式下,只有
ADC的数据从设备中读取。混合模式(CRA :0 = 1和
CRA : 1 = 1),使用户能够发送控制信息,并
无论是接收控制信息或ADC数据。实现这一点
通过使用16比特的帧作为标志位的MSB。混合模式
降低了分辨率为15位,最高位被用来
表示在16位的帧中的信息是否是控制
信息或ADC数据。
的体育设有一个用于一个16位串行寄存器
输入和输出的数据传送。作为输入和输出
数据必须共享相同的寄存器,需要注意如下
观察到。主要预防措施是,没有信息必须
写入到体育不参考的输出样本
事件,也就是当串行寄存器将被改写
最新的ADC采样字。一旦SPORT开始输出
最新的ADC词,它是安全的DSP写入新的控制
话到AD73360L 。在某些配置中,数据可以是
写入设备与输出样本是一致的
移出串行寄存器见对接口
设备。串行时钟速率(CRB :2-3)确定有多少个16位
字可以写入到一个装置中的下一个输出样值之前
事件发生。
在体育框图,在图9中示出,详细说明了块
与AD73360L包括八个控制寄存器相关联
( A-H) ,外部MCLK的内部DMCLK分频器和串行
时钟分频器。分隔率是由的设置控制
控制寄存器B的AD73360L设有一个主时钟
分频器,允许用户从外部划分的灵活性
可用的高频DSP或CPU的时钟,以产生一个低
内部高频主时钟的AD73360L这可能是
更适合于任一串行传输或采样速率要求一
求。主时钟分频器有五个分频选项( 1 ÷
默认情况下,
÷
2,
÷
3,
÷
4,
÷
5 ),其通过加载设置
用适当的寄存器B的主时钟分频器域
代码(见表十三)。一旦内部设备主时钟
( DMCLK )使用主时钟分频已被设置,所述样品
率和串行时钟的设置都源自DMCLK 。
在体育可以在四个不同的串行时钟(SCLK)率工作:
从DMCLK , DMCLK / 2选择, DMCLK / 4或DMCLK / 8 ,
其中, DMCLK是内部或设备的主时钟产生
从外部或销主时钟除以主
时钟分频器。护理应选择主时钟时服用,
串行时钟和采样率分频器设置,以确保
有足够的时间来读出从AD73360L的所有数据
下一个采样间隔之前。
该AD73360Ls经由主机处理器通信
双向同步串行端口(SPORT ),这是相容
IBLE与最现代的DSP 。该运动是用来传输
和接收数字数据和控制信息。两个AD73360Ls
可以级联在一起,以提供额外的输入通道。
在发送和接收模式下,数据传送的
串行时钟( SCLK)速度与MSB被转移连接第一个。
由于这一事实,即每个AD73360L块用途的体育
常见的串行寄存器的串行输入和输出,通讯
一个AD73360L和一个主处理器( DSP之间的阳离子
发动机)必须始终由AD73360Ls本身发起。
在这种结构中, AD73360Ls被描述为在被
主模式。这确保之间没有碰撞
输入数据和输出采样。
SPORT概述
该AD73360L SPORT是一个灵活的,全双工,同步
串行端口的协议已经被设计为允许最多
8 AD73360L设备进行级联连接,以一个单一的
通过6线接口的DSP。它有一个非常灵活的架构
可以由内部的编程2被配置
控制寄存器中的每一个设备。该AD73360L SPORT都有
三种不同的操作模式:控制模式,数据模式
和混合控制/数据模式。
MCLK
DMCLK
(内部)
SCLK
MCLK
分频器
SE
RESET
SDIFS
SDI
3
8
控制
注册
A
8
控制
注册
B
8
8
控制
注册
C
控制
注册
F
串行端口
( SPORT )
串行寄存器
SCLK
分频器
SDOFS
SDO
2
8
控制
注册
D
控制
注册
G
8
控制
注册
E
控制
注册
H
图9. SPORT框图
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