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EBD25RB4ALFA-1A 参数 Datasheet PDF下载

EBD25RB4ALFA-1A图片预览
型号: EBD25RB4ALFA-1A
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内容描述: 注册256MB DDR SDRAM DIMM [256MB Registered DDR SDRAM DIMM]
分类和应用: 存储内存集成电路动态存储器双倍数据速率时钟
文件页数/大小: 17 页 / 130 K
品牌: ELPIDA [ ELPIDA MEMORY ]
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EBD25RB4ALFA  
Byte No. Function described  
95 to 98 Module serial number  
Bit7 Bit6 Bit5 Bit4 Bit3 Bit2 Bit1 Bit0 Hex value  
Comments  
99 to 127 Manufacture specific data  
Block Diagram  
VSS  
/RCS0  
RS  
RS  
DQS0  
DM0/DQS9  
DQS  
DQ  
/CS DM  
DQS  
DQ  
/CS DM  
RS  
RS  
RS  
RS  
4
4
4
4
4
4
4
4
4
4
DQ0 to DQ3  
DQS1  
DQ4 to DQ7  
DM1/DQS10  
D0  
D9  
DQS  
DQ  
/CS DM  
DQS  
DQ  
/CS DM  
RS  
RS  
RS  
RS  
4
4
4
4
4
4
4
4
DQ8 to DQ11  
DQS2  
DQ12 to DQ15  
DM2/DQS11  
D1  
D10  
DQS  
DQ  
/CS DM  
DQS  
DQ  
/CS DM  
RS  
RS  
RS  
RS  
DQ16 to DQ19  
DQS3  
DQ20 to DQ23  
DM3/DQS12  
D2  
D11  
DQS  
DQ  
/CS DM  
DQS  
DQ  
/CS DM  
RS  
RS  
RS  
RS  
DQ24 to DQ27  
DQS4  
DQ28 to DQ31  
DM4/DQS13  
D3  
D12  
DQS  
DQ  
/CS DM  
DQS  
DQ  
/CS DM  
RS  
RS  
RS  
RS  
DQ32 to DQ35  
DQS5  
DQ36 to DQ39  
DM5/DQS14  
D4  
D13  
DQS  
DQ  
/CS DM  
DQS  
DQ  
/CS DM  
RS  
RS  
RS  
RS  
DQ40 to DQ43  
DQS6  
DQ44 to DQ47  
DM6/DQS15  
D5  
D14  
DQS  
DQ  
/CS DM  
DQS  
DQ  
/CS DM  
RS  
RS  
RS  
RS  
DQ48 to DQ51  
DQS7  
DQ52 to DQ55  
DM7/DQS16  
D6  
D15  
DQS  
DQ  
/CS DM  
DQS  
DQ  
/CS DM  
RS  
RS  
RS  
RS  
DQ56 to DQ59  
DQS8  
DQ60 to DQ63  
DM8/DQS17  
D7  
D16  
DQS  
DQ  
/CS DM  
DQS  
DQ  
/CS DM  
RS  
RS  
CB0 to CB3  
CB4 to CB7  
D8  
D17  
R
S
/CS0  
BA0 to BA1  
A0 to A12  
/RAS  
/RCS0 -> /CS: SDRAMs D0 to D17  
R
* D0 to D17: EDD1204ALTA  
U0: 2k bits EEPROM  
RS: 22  
PLL: CDCV857  
Register: SSTV16857  
R
S
R
S
R
S
R
S
R
S
R
S
RBA0 to RBA1 -> BA0 to BA1: SDRAMs D0 to D17  
RA0 to RA12 -> A0 to A12: SDRAMs D0 to D17  
/RRAS -> /RAS: SDRAMs D0 to D17  
E
G
I
S
T
E
R
/CAS  
/RCAS -> /CAS: SDRAMs D0 to D17  
CKE0  
RCKE0A -> CKE: SDRAMs D0 to D17  
Serial PD  
/WE  
/RWE -> /WE: SDRAMs D0 to D17  
/RESET  
SCL  
SCL  
SDA  
SDA  
PCK  
/PCK  
U0  
VDDQ  
VDD  
D0 to D17  
D0 to D17  
D0 to D17  
D0 to D17  
A0  
A1  
A2  
VREF  
VSS  
SA0 SA1 SA2  
Notes:  
1. The SDA pull-up resistor is required due to  
the open-drain/open-collector output.  
2. The SCL pull-up resistor is recommended  
because of the normal SCL line inacitve  
"high" state.  
VDDID  
open  
CK0, /CK0  
PLL*  
Note: Wire per Clock loading table/Wiring diagrams.  
Preliminary Data Sheet E0211E11 (Ver. 1.1)  
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